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如何勝任高級ASIC設計工程師?

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發表於 2006-8-8 11:39:50 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
以數位ASIC設計佔台灣高達50.9%比例,ASIC設計工程師當然舉足輕重!以下是某家公司對於這項工作的徵才需求,依照你的經驗,哪三項條件會是勝出的關鍵?來交流一下為什麼吧?  z% ^0 r  x  b$ Q" b1 t& ~

3 _( D1 ?5 }# Y! g職責:負責模組級設計和架構設計
7 t& C0 A2 k! H1 ]0 ^- d要求:
4 e  A: N6 q3 z) a+ F5 H$ e' Q具備扎實的數位電路基礎;/ A2 R; H  u5 o/ d3 Z7 C, a7 Z0 i; R
具備良好的團隊工作精神和溝通能力;8 q2 j% S7 P  h4 F- D
精通Verilog語言編程;) i6 M# ~: ]) t8 q% [
熟悉NC-verilog 或 VCS等仿真工具;
+ S# O) F* U: ^. w9 z8 q熟悉Design Complier 或其他綜合工具優先
+ _! Y, i. n6 A具備晶片tape out經驗優先
1 ]/ {! |! W& \; W8 b  f具備通信理論基礎優先;
2 i0 G. O! r) @& K2 s* y相關學科學士以上學歷,碩士優先;+ C$ i' N  n/ ^3 z
5年以上工作經驗;
多選投票: ( 最多可選 3 項 ), 共有 27 人參與投票
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2#
發表於 2007-1-13 00:28:10 | 只看該作者
若僅以負責模組級設計和架構設計而言:" Z$ Y# E  X# s  _, E% b1 g4 ~) w( C" t' q
具備扎實的數位電路基礎==> 基礎夠扎實,架構設計才能得心應手
7 \4 C# E- B6 a" S1 R7 |4 `1 x3 U具備良好的團隊工作精神和溝通能力==>模組級設計當然要跟Team Member作良好的溝通  a- b/ j3 B  U# l7 H6 k
熟悉Design Complier 或其他綜合工具優先 ==>要整合成模組級電路,合成的技巧也很重要
" R9 I9 \% m9 P" i9 U8 d當然其他條件也是蠻必要的..
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