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layout 設計風格之討論!

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1#
發表於 2008-12-11 14:45:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
layout人員拿到一個電路以後,應該如何布局電路呢(我只指一個模塊)
2 Z3 x, Z) W: i$ Y# O: m4 n8 g, q
4 f+ j- K. K' Z# U) h我喜歡把PMOS和NMOS各放一排,PMOS放在上面,而NMOS放在下面。電源和和底線呈上下平行走線。這樣似乎比較浪費面積。匹配管子比較偏好交叉二維匹配。
% Z$ j+ C! M; L. L
& R* D; R2 ]" n% k各位大大,你們是怎么布局的呢?
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2#
 樓主| 發表於 2008-12-11 14:47:34 | 只看該作者
請大家說說自己的風格。討論各種方法的優缺點。
3#
發表於 2008-12-17 19:41:47 | 只看該作者

回復 1# 的帖子

應該先看看是類比電路還是數位電路吧?$ ]1 \9 k# ?' q( @; O
1 F- E* _7 {  r! g9 c
如果是邏輯電路 PMOS NMOS分別放上下兩排
0 S& d/ t: j) C這我也是這樣做
# z( p; z$ q- X; u
8 M1 V" H( |9 ]- e  H( o) O. u% u類比電路就不一定了
4#
 樓主| 發表於 2008-12-18 10:48:16 | 只看該作者
咋都沒有人討論?????????????
5#
發表於 2008-12-18 12:43:39 | 只看該作者
我觉得Digital和Analog差别还是比较大的!
  q# w* `) o+ G: c; b# Y5 {Digital主要是size方面比较优先考虑
; ~- i0 ~, u/ M: [" E( _0 w+ [, b$ E3 Z5 e$ M
Analog主要是性能和匹配方面要优先考虑
6#
發表於 2008-12-24 17:23:02 | 只看該作者
我lay的是analog ic,我習慣先lay 重要的mos(p/n),接著擺重要mos上面或下面的current mirror,最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走,power路徑等等。當然最後都會是一個很漂亮的方形。
7#
發表於 2008-12-24 20:37:26 | 只看該作者

回復 6# 的帖子

,很不错!
8#
 樓主| 發表於 2008-12-25 12:52:22 | 只看該作者

回復 6# 的帖子

有段时间就这个问题有点困惑,6楼兄弟给我了点启发!不错。
9#
發表於 2008-12-26 20:11:25 | 只看該作者

感恩

贊哦∼$ a1 \+ k5 ]  S) m
感覺真是收穫良多
) R. [1 I- R3 c4 i* M- h謝謝各位大大無私的奉獻贊哦∼
, x/ ^! J; x1 F- t6 R  X感覺真是收穫良多
/ T$ ~' l+ S5 J- @, z6 l) B  g謝謝各位大大無私的奉獻
10#
發表於 2008-12-29 17:38:14 | 只看該作者

回復 6# 的帖子

完全同意... . z) Q: Z7 }  F3 a8 c& Z! U, ?
還有我會留意所有的well, diffusion 是不是足夠,而且最好是矩形8 y& {  Z7 E0 D7 Z2 ~
再看看metal 上的via 是不是足夠,多加一點可以對yield 有點幫助
11#
發表於 2009-2-3 15:20:32 | 只看該作者
謝謝6樓大大這麼好的見解。
9 s! _; A; o2 P0 M) F8 V8 x( P進layout界快滿2年,總覺得自己還是原地踏步…
! t1 u: U% u9 r- {2 p, X有時想起來挺慌的。
12#
發表於 2009-2-3 16:11:18 | 只看該作者
多做项目才行!多看产品也行
13#
發表於 2009-2-9 17:01:50 | 只看該作者
是啊,我进入Layout行业也快一年了,感觉自己进步的很小,每次看到人家的布局,就感觉自己画的太刺了.
14#
發表於 2009-2-11 15:36:57 | 只看該作者
看電路的複雜度 先做好floor plan 儘量做成方型 才是 layout 王道呀!!
15#
發表於 2009-3-5 09:41:09 | 只看該作者
学会合理布局才算是入门,要知道自己为什么这么布局,好处在哪,还有什么要改进的地方,能说出一二三来,就算有进步了
16#
發表於 2009-3-5 10:55:46 | 只看該作者
真是好觀念, s% z# Y6 j7 ]8 _! L6 f
先劃重要的mos再劃current mirror其他留最後2 ^6 a9 c, i+ J
不過通常結果大概都是pmos在一起,nmos在一起9 a( e; B' T- \9 ]  e
所以我以前總會有analog layout與digital layout plane
8 `% O4 \* K* h) F8 U很像的感覺,現在離清它們不同之處了
17#
發表於 2009-4-23 15:09:19 | 只看該作者
會先了解POWER LINE的路徑走向為何
8 Y/ s2 H+ X. c4 U+ i3 V' t$ D再來擺放MOS即接線
& ~' }& v+ [2 W( i8 k. t或許有些籠統/ j8 _+ l2 |9 O6 ~  w7 N
因為我LAY的是DIGITAL# R' h" t. X) X
所以了~~~盡量壓空間就是了* Z/ H) M3 w& Z# |% I
當然最後還是要成矩形
18#
發表於 2009-4-23 22:17:10 | 只看該作者
贊同六樓大大所言
5 y8 ^% Q$ y2 ?" x& C( I/ Q: T. r1 P1 m5 S2 v. I
analog ic,我習慣先lay 重要的mos(p/n),接著擺重要mos上面或下面的current mirror,最後再擺switch mos或logic gate。一邊擺一邊想訊號怎麼走,power路徑等等。當然最後都會是一個很漂亮的方形。
19#
發表於 2009-7-20 12:02:33 | 只看該作者
我是會先看整各TOP電路的關連, 想POWER LINE 要怎樣走,接著跟六樓樓主差不多,也事先把一些 current mirror 或是需要common centroid 的MOS 先畫,燃後在慢慢擺上一些比較不需要注意對稱或是偏數位的電路上去,先考量效應跟連接的關係再考慮面積(類比電路),
20#
發表於 2009-7-20 15:19:10 | 只看該作者
如IC過大, 需與其他人共同合作的話, "界面"與訊號可能要先定義清楚較佳.( Y" W" E# F3 ^& H" H% z2 F; @
確實, analog layout 不能清一色要求面積小, sensitive path, cross talk, match, and isolation 要優先考慮...
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