|
进入芯片的静电可以通过任意一个引脚放电,测试时,任意两个引脚之间都应该进行放电测试,每次放电检测都有正负两种极性,所以对I╱O引脚会进行以下六种测试:
& s; k6 o$ |* g4 ^1 r! g9 w4 T1) PS模式:VSS接地,引脚施加正的ESD电压,对VSS放电,其余引脚悬空;
' n& f; ~( J( s- o% h0 v2) NS模式:VSS接地,引脚施加负的ESD电压,对VSS放电,其余引脚悬空;
# t* h2 x, f! P. V$ \( i3) PD模式:VDD接地,引脚施加正的ESD电压,对VDD放电,其余引脚悬空;
/ g( _/ V! c% K J- n. q4) ND模式:VDD接地,引脚施加负的ESD电压,对VDD放电,其余引脚悬空;
3 {* R8 O- O- _5) 引脚对引脚正向模式:引脚施加正的ESD电压,其余所有I╱O引脚一起接地,VDD和VSS引脚悬空;
2 ~9 u {) K, f6) 引脚对引脚反向模式:引脚施加负的:ESD电压,其余所有I╱O引脚一起接地,VDD和VSS引脚悬空。
( n& M# i$ h* }# F- q# qVDD引脚只需进行(1)(2)项测试
a& L. F5 ^6 ~( D$ h- H( z4 i4 }, Z2 m6 C+ l9 G
应该是one by one 的测试,管脚多的话,排列组合就多,很费时的。 |
|