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PMOS Low_Dropout Voltage Regulator Introduction

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發表於 2008-10-1 20:26:02 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
1 Constant-Voltage Source 8 }8 d- y+ t  {3 Q/ T  X2 R
2 Output-Voltage Error vs Load Resistance 1 S+ u! h. w5 h# V6 g" e" x
3 Linear Relation Between RIN and RLOAD ' B( ^* t  p$ P. Z6 k" f
4 Basic Linear-Voltage Regulator
, b& ~5 |+ F6 z. u1 |& z4 S5 PMOS Enhancement FET
* F9 L* W' g" A* ~! g& v1 t( b6 Regulation Sequence When RLOAD Drops 7 Regulator Block Diagram PMOS Input/Output Characteristic , a+ [$ f& e3 H* ~
& ^% n! b3 g) m: N+ o; v( O6 Z
看過後  歡迎討論ㄛ.; P8 Z/ a1 M5 s4 b8 [6 _
我是看過啦.  Z" q, p  y* e( w8 Y

- F5 Y0 o1 z9 f' Q5 m

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