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PMOS Low_Dropout Voltage Regulator Introduction

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1#
發表於 2008-10-1 20:26:02 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
1 Constant-Voltage Source ' ]2 p, _8 B0 p% X
2 Output-Voltage Error vs Load Resistance , B% f; w9 x/ `4 k6 n& J
3 Linear Relation Between RIN and RLOAD 6 n+ A' P3 X$ I- p; M
4 Basic Linear-Voltage Regulator
5 G( i" S8 U) X$ `1 l5 PMOS Enhancement FET
+ }; Y0 n. h2 K0 P3 I" K6 Regulation Sequence When RLOAD Drops 7 Regulator Block Diagram PMOS Input/Output Characteristic
" E1 R" k3 O$ d  p! r# T4 Y3 U. s$ ~7 }9 Q0 @
看過後  歡迎討論ㄛ.4 P; z. y- Y8 Z) F# X: f5 P5 ?
我是看過啦.7 F  d, i. [  X. r+ Z, ~  Q: P, D
! H( {' F6 H& M$ p& L  S) k

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13#
發表於 2011-9-22 09:39:15 | 只看該作者
謝謝分享,小弟來學習一下!
12#
發表於 2011-9-21 09:15:29 | 只看該作者
但是LDO原本就是要將輸路的電壓拉低嗎?6 n2 b( F3 f9 W9 G! K1 N
那怎麼會出現在低電壓操作?
11#
發表於 2011-8-25 14:48:41 | 只看該作者
為什麼LDO的輸出是PMOS而非NMOS  我陳述一下自己的想法 不一定正確  歡迎指正~~  
! `! u1 V' d4 W1 v' B如果~LDO的輸出為NMOS的話~那顆NMOS的threshold voltage應該會很大
# x, e6 J2 I* X8 v& k造成NMOS的 Vgs應該也要很大~這樣LDO的supply voltage 就不能太低 無法工作在低電壓下
10#
發表於 2011-8-25 10:27:22 | 只看該作者
我剛剛看了一下,沒發現我想知道的@@"" F! V  T# W+ K9 W" f5 C
如果我想在很低電壓去驅動OP那,我怎麼設計用CMOS四支腳當輸入,) S5 [3 R7 x. y
來產生在低電壓操作的OP~。
9#
發表於 2009-10-27 23:35:59 | 只看該作者
這幾天正在做LDO/ ]+ \$ U- C& y: d, e  Y+ ~. y6 P
正需LDO這方面的知識; b0 V, D. T: e  A7 y
THX大大,辛苦了
8#
發表於 2009-10-27 23:35:43 | 只看該作者
下载来看看 下載看看先~~~~~~~~~~: S( M$ E' Y' W6 j3 z' y
下載看看先~~~~~~~
( n2 B& j* E5 R. `: s, W下載看看先
7#
發表於 2009-5-19 07:02:14 | 只看該作者
同样的问题,为什么现在都用PMOS?是不是因为可以获得更加大的VGS?
6#
發表於 2009-4-9 00:49:03 | 只看該作者
我們公司就是做這個啦,來了解一下感謝大大的分享阿!!!!!!!
5#
發表於 2009-1-13 00:27:45 | 只看該作者
(科)技最新進6 o$ I# E5 t+ \, s- ?, p% {+ i
(技)術都領先
+ r( {1 H# \7 x" E(新)手真是慘1 N6 w6 F0 C* c2 |
(貧)窮都沒錢
4#
發表於 2009-1-13 00:23:41 | 只看該作者
目前就是在做這個啦!
1 p$ G- v; n, N0 M從高頻降頻下來, r0 {1 Y, J' _* X, c; s
真有點不太習慣
% P, y% s0 y" V9 n. M不過感恩阿
3#
發表於 2008-10-3 19:51:41 | 只看該作者
想問問 為什麼 PMOS是主流?
3 O3 F1 {9 ?/ U  H是否因為  PMOS 可以 Pass Good "1"的關係?
2#
發表於 2008-10-2 12:31:26 | 只看該作者
這可是好東西,坐沙發耶,linear regulator的pass gate現今的應用,應該99%都是用Pmos(power mos),感謝大大無私分享,3Q~
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