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[問題求助] �定周期,可变的DUTY,如何实现?

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1#
發表於 2008-4-28 22:38:35 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
附图是一个OSC电路,可知T=C*(VH-VL)/I1+C*(VH-VL)/I2;% j+ R0 s9 j$ b8 H' F. z
/ s4 A' T7 c( L$ Y& r( U) m
可以通过调整C,VH/VL,I调整频率,如果要获得�定周期,可变的DUTY,如何实现呢?6 I$ U3 [+ s( e& W: {- I
( ~8 b" J, B+ y. c
请各位大大指教,谢谢!0 i6 h; i) f4 S; ~5 w+ S1 H
; G5 u' Z' k  \

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2#
 樓主| 發表於 2008-5-3 11:04:31 | 只看該作者
各位大大,有没有好的方法,请指教,谢谢!
3#
發表於 2008-5-5 23:16:44 | 只看該作者
我以前有試過一種在vco後面加duty cycle correction電路,那是為了校正vco的duty cycle而衍化出來的電路" Q& M) I* @8 i" Y
那是一種利用負回授的方式來實現的電路
; A2 _0 _0 N/ h( W  Y3 t不過,這種電路可能不太適合你的需求
- B- p: e, t8 Y6 {
; A" c& M- [- j1 M8 Y而因為你需要固定週期內去變duty cycle的話
$ }! T( ?1 I) `7 ^+ t3 y" j" B那惟有在sr-latch後面再加一些數位電路應可達到改變duty cycle的功能
5 S* i1 h1 d' R基本上我想到的方式是利用delay cell再加一些數位邏輯電路應可實現" {; u8 `8 E+ d  w% Y  E- v2 t& B
若想加長duty cycle,那就用OR Gate + delay cell電路(加長)應可達到需求
) O0 z. Q1 Z2 `, g, b若想縮短duty cycle,那就用AND Gate + delay cell電路(縮短)應可達到需求5 g/ H7 e3 `! D2 m
如此一來,便可利用數位控制的方式,藉由控制delay cell timing即可作出想要的duty cycle
4#
發表於 2008-5-6 15:09:02 | 只看該作者
題外話 ( J6 u0 i% g+ d9 m% q
VCO duty cycle corrector 是很好玩的電路 / {! g4 ~; u9 S. G$ P4 v5 P
我之前有發明一個 拼湊一些paper的概念所組成的電路 也是用負回授的方法來產生50/50的clock
, D  C: Y6 o/ z0 s, j& F% ~finster大能分享一下如何實現的嗎 也許我可以觀摩一下
3 V3 [& K" E  D! ~; T我另外再開個討論版好了
5#
發表於 2008-5-6 18:17:37 | 只看該作者

回復 1# 的帖子

也許可拿你電路產生的定頻clock去充放電另外一個可變的CAP或充放電固定的CAP
8 V! g* L  J: w  Y" v,改變比較器的轉態電壓~~~試試吧
6#
發表於 2008-5-7 15:53:27 | 只看該作者
這是我想到的方法3 X% F1 y% T7 ~( d/ t: a
利用delay cell和簡單的數位電路應該就可以改變duty cycle' Q  L7 g- u+ a
因為提問者的前提是clock不能被改變,所以,就只能從輸出的clock著手動手腳,如果改變本身charge/discharge current,或者Vh/Vl電壓,或者電容C值均會改變原來的振盪頻率# h  W1 x1 M" G& h  ?! W( b  {
不過,這種方法有些缺點,因為delay cell的精準度很難控制,所以,未必能夠很精準的控制duty cycle,當然,如果要很精準的控制delay time,相對的電路就要設計的複雜些0 S- T3 Z# Y4 U6 {& @  r% `
再者,如果clock愈慢,表示其delay cell的delay time要設計的愈寛,那用反相器加電容的delay cell未必適合

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7#
發表於 2008-5-8 11:29:18 | 只看該作者
用定頻的clock去控制充+放電時間,所產生出來的clock應該是同樣頻率,: Y% u* d) S) ?
改變電容值或轉態電壓,便可以控制duty,用delay cell做,很難cover較寬
' s2 ~/ ?& j8 L$ `0 r5 H# I的頻率,並非上策
8#
 樓主| 發表於 2008-5-8 21:13:11 | 只看該作者
finster大大是利用BBM(break before make)的方法去做的,谢谢!" A! ?% o, t+ R# q+ V+ ~
2 h2 Z' ^% g) v* F
如果DUTY不连续变化,那么调整CAP可以改变DUTY(固定周期)
  w: O# h% u  f" ~T=C1*(VH-VL)/I+C2*(VH-VL)/I,,充放电用不同的电容大小,只要保证C1+C2不变,就可以保证频率不变了(理论上的),% G% \" r+ I7 A5 f9 x
DUTY连续的变化,上述方法就不好实现了................
. _! h, F* O- C9 p4 |  v, {/ t# m) k8 ~1 o3 K
mbission大大能再具体的讲一下吗 多谢!
9#
發表於 2008-5-9 09:36:05 | 只看該作者
用你上面的電路產生出來的定頻的clock,去控制另外一組RC充放電電路9 h! B4 A' h6 C' E0 R
,改變充放電電流比例或切換轉態電壓,應該可以得到你要的波形~~~
10#
發表於 2008-5-10 23:07:10 | 只看該作者
其實上面這個OSC RC 充放電線路,就是555 timer IC的線路主要設計,只不過少了voltage control input(可用來調duty cycle)' M1 |! x, k* V! h
稍微改了一下,看可不可以.(VR 用來調duty cycle)
: G/ N7 E5 P$ p6 e1 J5 \) b1 d+ I/ S7 A  B$ e, ^8 {

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11#
 樓主| 發表於 2008-5-11 16:03:27 | 只看該作者
谢谢kevin!8 y" U( L# @( w2 _' F
4 p; J8 j4 v" l5 l5 o8 f' ^
但是如果VR变化了,那么频率也会一起变化的
12#
發表於 2008-5-12 10:16:18 | 只看該作者
我是假設R4 跟VR很大,所流過的current很小,則VH-VL會保持不變(只跟R2有關),則頻率應可固定.
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