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│          DDI0337G_cortex_m3_r2p0_trm.pdf
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% N4 r% G- P" O' ?9 x6 |1 L, B3 }6 K│  │  │          CM3CodeMux.v
0 a3 ^6 p2 J4 w" W& R& }│  │  │          CM3flashmux.v
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│  │  │         
│  │  ├─dapswjdp
/ _  C5 W+ q' B│  │  │  │  README_DAPSWJDP
│  │  │  │  
6 r; g* V  P) T/ v4 L│  │  │  └─verilog
5 ~' v6 c" }/ q6 |, L+ ^2 V0 O' T│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
3 O6 ]. b+ C1 G  n' |│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
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7 ?* {% l3 ^1 m7 E' C│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
2 t$ f% g* {( u; O│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
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│  │  │          DAPSwjDpDefs.v
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│  │  │         
│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
8 t2 t! l9 n1 J3 K│  │  │         
) d" ?) S2 [; c' q. M' k! b│  │  └─tbench
3 a" r+ f( v4 l% o3 R5 w3 J* y│  │      └─verilog
│  │              AhbToApb.v
! B8 i! Z4 A; C, F│  │              AtbLogger.v
% f2 M* r7 ?# x3 I! |6 \# L/ \4 v│  │              BusMatrix.v
│  │              ClkReset.v
# K5 X) w/ U2 t9 j2 s( ?│  │              CM3BusComparator.v
1 Y+ a3 e  ]% p: _4 K. E& X
2 \8 O6 K: z8 F0 q- e
7 {" r6 C3 t) z: R  o/ z│      │  │  exclude_list.sc_waitstate

2 p8 j; b4 B% x             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
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' ^+ a, T* N& x* r" X  O             │              cells_1.geo
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├─integration_kit
7 D. v% `" Y% W3 ?│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
│  │  └─tbench
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