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0 c4 E3 f, E5 X" l6 K5 ~
iconstart@gmail.com
0 o4 j1 m  I; K
├─AT420-DA-03001-r2p0-00rel0
│  └─docs
3 D8 y% t8 Z! C' |* ~│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
; I5 |! t  k$ \* ^* E& \│         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs

│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
0 i/ r+ e; r3 B7 r3 `. l( }! {( x│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
│  │  │         
│  │  ├─dapswjdp
0 }- \, ^- T5 L* v5 ]( G│  │  │  │  README_DAPSWJDP
# v; w. z! \3 T, f9 s/ @' t- L! Y│  │  │  │  
& s! p1 f- C, K, P$ C│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
8 o' ?# u% W) S/ ~" b│  │  │          DAPDpApbSync.v
4 j% P7 {6 E; G│  │  │          DAPDpClamp0.v
0 p5 y' L0 y" T" I+ }, j' [2 ?9 n│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
! \5 E4 g" ?; Z- A/ Z" R│  │  │          DAPJtagDpProtocol.v
, A- P/ L, U6 U* ~# c/ J│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
; v7 A5 U, [! J' v+ q│  │  │          DAPSwDpSync.v
9 M* Q4 M# x2 Z* j$ v' Q│  │  │          DAPSWJDP.v
; ]- `. a. |9 L. ?2 R7 o" ?: M/ `│  │  │          DAPSwjDpDefs.v
  f2 H. ^) w1 X% z$ T0 ^9 Q  l( p( j" W│  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
│  │  │  └─cells
. y2 O! y2 ^$ y' @  T- g$ C│  │  │          CM3ClkGate.v
0 `) E7 T3 N  j1 B│  │  │          CM3EtmClkGate.v
3 P1 _+ z& @- j/ F4 [9 g│  │  │          CM3Sync.v
, p' d- q% \* C. X: _; c│  │  │         
│  │  └─tbench
│  │      └─verilog
8 \  O7 L% T" |) t6 w4 t- ~8 z, W  q│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
9 c, V( x7 C( n" v8 ?│  │              ClkReset.v
│  │              CM3BusComparator.v


. c/ L7 P4 w7 w% P6 n│      │  │  exclude_list.sc_waitstate

             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
* z8 x* I% j% C& G. U7 Z             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
, J! P5 s9 u% O             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
; u3 ]8 Q2 I: t& ~: O+ V8 F             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
) ~. e* {1 T3 B1 L; t. k# }3 v             │      │  
! [& P9 }1 K; Z6 I8 ]& v0 a& S0 }' f             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
3 j9 K4 ]& K7 ?' f0 i             │              cells_1.geo
             │              cells_1.pwr
             │              index.cli
             │              README.TXT
             │              rulesets
             │              VERSION.TXT
             │              vias_1.geo
6 ?9 {6 I. \( d& Q. z8 H& S. \             │              
             └─tsmc
; Y: G$ _! L$ u4 A- O                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
                             corner.defs
* r/ {6 B0 ]7 ^! u5 @* C; a
6 v4 c$ G& \( J4 A/ t& j' F├─integration_kit
2 m: {- d2 d$ R- ~8 s2 |6 \│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
│  │  └─tbench
) l) H3 P9 I5 b3 f│  │      └─verilog
│  └─validation
│      ├─glogs
│      ├─logs
│      ├─mdk
│      ├─srpg
4 q& ~5 q& G" v8 T  J2 s│      ├─tests
│      │  └─CMSIS
│      │      └─Core
4 P( W* t2 L! J; k│      │          ├─CM0
│      │          └─Documentation
6 g' W/ W1 v- A& t9 `( D" J/ P│      └─vectors
├─ipxact
# _& Q: A, C; o% o│  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
# N+ Q- u) _" L: R│  │  └─arm.com
% A8 X) }8 B- E. k│  │      ├─CoreSight
│  │      ├─Cortex-M0
. o8 z, A5 r3 J│  │      └─CortexMCores
/ I- J1 n, E! k0 W7 a│  ├─channels
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+ p, `/ K4 x; |+ {2 p  `│  │      └─Cortex-M0
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