M0 M3 M4 Soft IP Cores For Sale

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├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
" }; v- Z$ K( `5 V) T │         
& }8 z3 }1 K0 p ├─AT420-DC-02008-r2p0-00rel0
/ a+ Q+ T3 F$ b( i │  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
7 y. h1 n; I6 G+ e ├─AT420-DC-13001-r2p0-00rel0
- |$ ~2 z3 P% |; W  r/ t6 J% `0 [ │  └─docs
$ Y8 z4 g  V- }$ {' x
- @% S! i, B1 L9 `4 R │  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
2 A  w( l) i, X │  │  │          CM3ROMTable.v
' o2 b! ~4 K1 S, `; L- R8 a │  │  │          CortexM3Integration.v
$ s9 w1 g$ a" O1 Y, G1 [0 m │  │  │         
│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
2 M/ x' C/ B1 R) u │  │  │  │  
8 T9 u" |" E4 I# [  _, f │  │  │  └─verilog
$ V5 p& r; H; @' y# T │  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
. w' g% r, R& V8 { │  │  │          DAPDpClamp0.v
% C8 x$ z, Z% @# c6 m5 B5 ^' P │  │  │          DAPDpEnSync.v
: A( ?4 p' ]1 d4 q% s │  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
8 Q. |! F! d. q+ A5 V" l! f, K │  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
1 U, z: Q0 T; a3 B2 p7 w │  │  │          DAPSwDpApbIf.v
' S9 c2 _% ^( j1 q! p │  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
* R- r  i$ o7 T0 H( V# b │  │  │          DAPSWJDP.v
2 K9 P0 ~' C  N" u/ {& S! B │  │  │          DAPSwjDpDefs.v
' k: j* R4 J! U4 t4 F4 f6 @- ]- D │  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
3 O/ y+ T( ]7 R8 R: c% a/ @ │  │  │  └─cells
│  │  │          CM3ClkGate.v
7 O( Z$ P$ r2 V/ O' ^ │  │  │          CM3EtmClkGate.v
$ K! j0 E4 |& b& K8 `" J. c │  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
) R' P6 U+ S# q( o5 x │  │      └─verilog
" D8 l' k5 i. G( w6 ^. O4 G0 x │  │              AhbToApb.v
│  │              AtbLogger.v
2 q9 u; J# d1 N! i" G0 T0 V1 z6 B │  │              BusMatrix.v
│  │              ClkReset.v
│  │              CM3BusComparator.v
9 m5 C" t: T* c0 N; h

│      │  │  exclude_list.sc_waitstate
- n- }% Z0 l/ T8 m& c; [
             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
2 @( K( H" T# G             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
* ]! r  U: H1 Y7 o; S) C             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
" c! J& n3 P! W5 X             │              cells_1.geo
6 i8 l# \/ n* O0 _% `             │              cells_1.pwr
             │              index.cli
             │              README.TXT
             │              rulesets
4 w" f" u5 P8 D2 @; c) _             │              VERSION.TXT
% `! `+ e9 ]& ]5 p             │              vias_1.geo
             │              
             └─tsmc
+ k( k0 ]" Q) q- _' g8 y" a0 M- L                 └─t-n90-lo-sp-002-f1_1_6a_20060914
) E2 _, A( i! b* P% s& m                     └─6X2Z
- z/ Q$ D& \& _! q0 J! s                             corner.defs

  @0 a" o& {/ [; ?; e# `5 e* Y, Q├─integration_kit
│  ├─logical
$ Y, v) G5 A& K8 p8 z3 X; T) @ │  │  ├─cm0ikmcu
* \3 w" M* t9 d% _5 R │  │  │  └─verilog
' E0 A! I4 E6 [ │  │  └─tbench
│  │      └─verilog
│  └─validation
│      ├─glogs
│      ├─logs
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  i) j7 r1 p2 m │      ├─srpg
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4 l* p6 W7 P% M1 o │      │  └─CMSIS
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1 k5 s) ~' g7 F! f │      └─vectors
6 v, I8 L) v* |2 ]' ^- D ├─ipxact
7 d  ]0 I4 ?5 `2 ]( Q; Z │  ├─busdefs
5 U# S; o1 w, F0 R' a │  │  ├─amba.com
: z; C* W4 d( ?( {6 {7 I │  │  │  └─AMBA3
' Y4 _( h* W6 a, B) w) g, \5 ~ │  │  └─arm.com
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