M0 M3 M4 Soft IP Cores For Sale

sinoicboy

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
% K7 Z; I' n6 M$ q% ~2 k │          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
) A* ^, F* W1 O0 W7 p" ^( v. s ├─AT420-DC-02008-r2p0-00rel0
5 e( F4 z. b9 h* m, H' X │  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
1 [+ `5 R+ u; y) d! _8 K; Y7 d │         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs

│  │  │          CM3CodeMux.v
# Q) Z1 s4 ^- } │  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
4 H9 X& k* @$ { │  │  │          CortexM3Integration.v
0 [& Q" d* P/ P9 C! b0 z; v' p │  │  │         
% `' A, Q+ V' r4 |" P │  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
  B# U" _, E  t+ F4 k" [ │  │  │          DAPDpApbIfClamp.v
( X0 `1 }3 [# J4 C- u │  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
# t, C# C5 Q$ ?7 W │  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
+ D3 M0 G# B* ]4 ? │  │  │          DAPJtagDpProtocol.v
6 B, p$ s- N" a+ ^) e │  │  │          DAPSwDpApbIf.v
2 ~9 c( h, j1 v  F5 K/ F7 ? │  │  │          DAPSwDpDefs.v
. O' B$ v9 q! Z: ~2 o! X4 M2 Y5 w │  │  │          DAPSwDpProtocol.v
, k6 f9 k( l: @& J* n │  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
( p% V  ^7 F1 b, f  d$ r" g5 C │  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
1 V2 p7 K, W4 Z2 O │  │  │         
│  │  ├─models
│  │  │  └─cells
9 T+ O9 V# N" o& f1 J8 s' U │  │  │          CM3ClkGate.v
9 S  K+ O: P$ U6 }5 Q: i9 ]" |- t; B │  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
. A. x* V8 ]7 v9 f% ~0 z7 {  s │  │  │         
- t0 G$ B' A# U" c) o- `; ~# o │  │  └─tbench
│  │      └─verilog
% o2 m$ q' P  c │  │              AhbToApb.v
│  │              AtbLogger.v
, }1 Q4 O, u; `3 ` │  │              BusMatrix.v
│  │              ClkReset.v
5 y; s5 |5 f0 f; ^  B │  │              CM3BusComparator.v
: W% L$ s! Y. I$ H- m& i' M% g( t4 p

│      │  │  exclude_list.sc_waitstate

0 O0 K! r, T- f. o1 J& Z             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
& p% }" X! s* j2 G4 }             │              cells_1.geo
+ n. M* z. O7 \2 P             │              cells_1.pwr
             │              index.cli
4 ?( }$ d% g7 o7 a8 |: k9 o- X             │              README.TXT
, X; D5 G- y5 g2 e: m# V+ J             │              rulesets
0 o. G( l. T$ }5 q# n             │              VERSION.TXT
             │              vias_1.geo
( `# o7 U9 \- k# J             │              
. m8 T+ k6 v# L! g/ _5 u6 n             └─tsmc
  ^2 C0 q6 y4 S1 q) F" X0 K9 _                 └─t-n90-lo-sp-002-f1_1_6a_20060914
+ Y+ u& K4 i4 s$ i' Q0 `                     └─6X2Z
$ k$ o/ c; J7 I                             corner.defs
/ p4 Q9 n* A) Q  l
├─integration_kit
7 m$ `+ D  u/ I' m4 o │  ├─logical
│  │  ├─cm0ikmcu
; E5 h1 Z2 W4 ~+ O! W/ E │  │  │  └─verilog
│  │  └─tbench
, F; ^6 P" f: { │  │      └─verilog
' ^# m+ d7 g% c9 s) \4 m/ F │  └─validation
* Q) l9 q" q+ v( ^7 H1 ^3 V: e │      ├─glogs
│      ├─logs
9 @% ]& _5 i/ Z; k' o: f  W2 S! X- h& B │      ├─mdk
5 k1 _  c' j' E- g4 ]7 X │      ├─srpg
9 d9 n0 |, C" G$ P# p% d2 f( b9 o │      ├─tests
$ P# n( K2 u9 b0 A │      │  └─CMSIS
│      │      └─Core
$ M. n) f0 D8 }7 n │      │          ├─CM0
# B$ S8 v  u9 ?, @ │      │          └─Documentation
│      └─vectors
0 d7 \$ p7 i8 E" n ├─ipxact
│  ├─busdefs
│  │  ├─amba.com
" I& U2 V2 [; p6 B │  │  │  └─AMBA3
│  │  └─arm.com
9 V) @7 y! r9 O6 J% [ │  │      ├─CoreSight
│  │      ├─Cortex-M0
│  │      └─CortexMCores
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