brief for Cortex-M0/M3 Logical Validation Implementation

sinoicboy

├─doc
. M5 ~6 q/ r9 g│  ├─Cortex-M0_TechnicalReferenceManual_Frame
6 Z: B( g3 }% u5 P│  │  └─graphics
) |6 W/ h7 i6 O│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
│  │  └─graphics
6 R$ c& b0 V2 R$ ?4 L+ X& c% z│  └─Cortex-M0_UserGuideReferenceMaterial_XML
* D: e: Y: \( Z+ D5 g" G│      └─graphics
├─implementation
│  └─vectors
│      ├─CORTEXM0IMP
! T9 p1 P. q3 H. ]9 w: I│      │  ├─crf
* Z* X# @' d  t% c& C│      │  ├─srpg
! y/ a+ Y& l3 V3 C2 I│      │  └─tbench
│      │      └─logs
│      ├─CORTEXM0INTEGRATIONIMP
│      │  ├─crf
│      │  ├─srpg
│      │  └─tbench
│      │      └─logs
│      └─tools
│          └─VerilogCrf
├─integration_kit
) m2 E$ N2 h8 ~) w- M& F4 Z9 R* V9 J│  ├─logical
│  │  ├─cm0ikmcu
" E6 m# b. c  Q! G2 x│  │  │  └─verilog
│  │  └─tbench
3 Z+ `9 O, ^8 ]9 y│  │      └─verilog
6 S" X3 @9 P7 T4 Z- R# }1 s│  └─validation
/ l3 x7 d8 l+ m9 K% l│      ├─glogs
│      ├─logs
3 p! [2 Z3 u; V  j│      ├─mdk
│      ├─srpg
1 f/ V$ j( p( ~: _│      ├─tests
│      │  └─CMSIS
│      │      └─Core
│      │          ├─CM0
  I- W. P6 j/ C* d# Y6 B│      │          └─Documentation
4 L7 I) ]+ \9 B' r! r) M│      └─vectors
├─ipxact
│  ├─busdefs
; H7 O# I7 K# X│  │  ├─amba.com
8 z7 a5 {2 A' ~, _/ o3 P1 H│  │  │  └─AMBA3
! z- v& e7 I2 ?; u, U│  │  └─arm.com
2 `0 ]- Z$ `) c% T' H0 Q│  │      ├─CoreSight
1 C& d9 A- P  U│  │      ├─Cortex-M0
* `$ z1 Z' W. |. n. ~& r8 L* B│  │      └─CortexMCores
│  ├─channels
& \, z+ t7 ~$ ]) g1 ]9 _4 m│  │  └─arm.com
% u: i# ]$ Q6 O. y9 t8 O│  │      └─Cortex-M0
│  │          └─rtl
9 ]+ t$ l8 R* m, o( x│  └─components
│      └─arm.com
* `7 V: Z4 }8 V" X' z% C- x2 ], g│          └─Cortex-M0
- ~  E4 E+ _, \9 N' M└─logical
1 h; D0 J, R6 G+ R; Z- G    ├─cortexm0
! J: R/ S0 S! X/ y7 R5 _8 p, w    │  └─verilog
$ \" r* `& E0 g* V# @    ├─cortexm0_dap
% d: _% ?/ m3 A/ u, @9 R    │  └─verilog
3 z$ E, p4 V8 j: a+ ^3 p& b" q1 f    ├─cortexm0_integration
1 @8 @$ w" [2 ?, ?1 Y) J    │  └─verilog
    ├─models
    │  ├─cells
    │  ├─cpf
. O! j, ~* T  L3 o/ @  A0 v    │  ├─upf
    │  └─wrappers
    └─ualdis
: J2 X# G( ]& H1 Q+ G( [        └─verilog

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sinoicboy

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
│  └─docs
% x1 r% M$ H' H& n│          DII0194A_cortex_m3_r2p0_csg.pdf
' E. i+ @1 b  @5 i% _/ Z│         
├─AT420-DC-13001-r2p0-00rel0
: ?  U' o" W8 G8 Z, N4 A│  └─docs

) m. j' q5 k" P7 Z, d│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
5 ^: R# b" S7 D9 A# p# a0 A│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
( Z, c3 m. O# |' h/ s! X- D; K│  │  │         
│  │  ├─dapswjdp
: v2 H" @( e6 H& I- ~│  │  │  │  README_DAPSWJDP
7 a! y' y0 B1 k$ P│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
  _' J  H$ o) r) w. N│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
% k9 R3 o# ?" E' i" n: H" A# J& `│  │  │          DAPDpEnSync.v
! |7 }* x* l6 u# B$ m9 ^│  │  │          DAPDpIMux.v
3 H8 M* V6 z& [4 ~9 J' x│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
, L9 ?& E1 {- a  b) j+ L│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
/ P2 Q8 _9 Z- H' j& I│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
3 `# K: Q8 i& O│  │  │          DAPSwjDpDefs.v
3 h: c/ J6 K: a│  │  │          DAPSwjWatcher.v
│  │  │         
3 C5 `* P- u; H. D│  │  ├─models
9 P4 k! N5 n& s/ O│  │  │  └─cells
│  │  │          CM3ClkGate.v
. G# H+ z. U6 Q& I- H6 Z: d- c! s│  │  │          CM3EtmClkGate.v
/ \& Q2 m" }; d! k│  │  │          CM3Sync.v
/ m: f: h. H+ z  [1 r; h0 B│  │  │         
│  │  └─tbench
│  │      └─verilog
3 K" l' ^) B6 Z7 q│  │              AhbToApb.v
) E" i$ _: A4 }! ^2 O# Z8 a' _+ i, C│  │              AtbLogger.v
│  │              BusMatrix.v
1 D6 T% s+ i& }& |- X" e│  │              ClkReset.v
$ v4 @6 V+ M0 l8 D  }* \│  │              CM3BusComparator.v
; M7 ?0 {- G+ O5 a, d│  │              CM3BusGasket.v
+ e- D% Z0 P# x│  │              CM3TestExAcMnAhb.v
0 D+ v; G( A9 ~/ V  z& Y│  │              CM3ValAHBSplit.v
│  │              CM3ValApbTrickBox.v
) P0 x; T2 a/ U1 j1 u! W% Q+ b│  │              CM3ValBusCompareCtrlReg.v
* d! U4 W3 n3 P1 @  V│  │              CM3ValControl.v
/ W7 v6 U( \0 d) B1 B$ r│  │              CM3ValDebugCore.v
0 J  t  s5 |  N, ^4 @" ?0 r│  │              CM3ValDualPortRAM.v
│  │              CM3ValDualPortWrapper.v
9 b: w+ R3 u* |- X7 O* r│  │              CM3ValETMTrickBox.v
8 ]* |$ y; I! ~. T│  │              CM3ValHTMTrickBox.v
│  │              CM3ValIRQGenerator1.v
│  │              CM3ValIRQGenerator2.v
│  │              CM3ValJtagTrickBox.v
# Q' J& {) m2 H8 Z1 ^# r│  │              CM3ValMemory.v
│  │              CM3ValPMU.v
│  │              CM3ValRAM.v
# [$ l% F& ]/ t, A" a( T│  │              CM3ValRAMWrapper.v
  [8 `# B# \, v, T' y' F│  │              CM3ValScratchPad.v
+ t! l. }( K$ A& s& [0 d8 L│  │              CM3ValSWCapture.v
│  │              CM3ValTBDefs.v
│  │              CM3ValTraceOutput.v
│  │              CM3ValTraceSync.v

│      │  │  exclude_list.sc_waitstate
& m3 b/ L, [$ a) e; C2 h3 C
            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
            │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
            │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
# B, r/ Q3 r! W( ]# a1 Q            │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
            │      │  
            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
" H0 k% t4 }: L/ e+ m3 p$ D& o            │              cells_1.geo
            │              cells_1.pwr
* v1 W. g% a0 I$ d            │              index.cli
            │              README.TXT
            │              rulesets
            │              VERSION.TXT
$ f0 `: e% |! N: n7 L  N- A! p            │              vias_1.geo
5 I" ]9 ^( H* `- R! [            │              
7 x$ W. ^4 r- m            └─tsmc
; u) a9 U# `" g) c$ Y7 n                └─t-n90-lo-sp-002-f1_1_6a_20060914
, w0 J3 N2 i1 B- i/ J* |) d                    └─6X2Z
& z' l! C+ b4 \4 [                            corner.defs

mdtjason

回復 2# sinoicboy
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talrasha

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jm2000

Chip123 科技應用創新平台

jm2000

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; w7 Y; ^9 ^8 ~3 B

cjwei

The Future for the IOT, M0 and M3 will dominate the market.
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yumumu1991

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