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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › EDA 設計討論區 › low power design的模擬環境
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[問題求助] low power design的模擬環境

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wsc223
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1#
發表於 2010-8-9 18:23:44 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位大大好
% K' C, F; s4 s" `因為開始要著手low power design的方面
& p8 A$ R0 Y7 d  [9 ?  w# e  }* O9 `小弟想請問一下
; O, M2 h  H0 l3 _: b' z4 H有什麼tool或是模擬軟件能夠用來幫助low power的設計呢  E) P: |5 @) j7 A, V  l
(比如說Dynamic Voltage Scanning 或是 multi-Vdd等的使用). }' c/ H' L  U

7 U+ B6 f  c2 G+ H: E& D7 t7 ^謝謝
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lee100
2#
發表於 2012-1-9 13:24:52 | 只看該作者
you may try UPF/CPF for low power designs
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