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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › EDA 設計討論區 › low power design的模擬環境
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[問題求助] low power design的模擬環境

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wsc223
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1#
發表於 2010-8-9 18:23:44 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位大大好
& N/ e3 v; Y% y( X& \+ B3 P/ a因為開始要著手low power design的方面
" T6 C& f: h4 [' f0 {* L+ G小弟想請問一下
/ l3 Q4 t* T! Q) ~! U0 |有什麼tool或是模擬軟件能夠用來幫助low power的設計呢! Z, i+ \: M8 P% {
(比如說Dynamic Voltage Scanning 或是 multi-Vdd等的使用)
( V! @0 i  I; T' Q/ l* R0 ^0 ]* l8 E  y5 `& y! F7 F# |
謝謝
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lee100
2#
發表於 2012-1-9 13:24:52 | 只看該作者
you may try UPF/CPF for low power designs
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