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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file
) ]3 s/ G: x& d2 U# l9 y  q" Y7 f請問reference library指的是??1 P+ E9 d) `9 y; M+ F' n( \8 ]
以及可以請教如何撰寫device mapping file嗎??
& C, c" @7 R4 J7 T3 i
& |* E6 B" e/ I8 g- f  o4 i" Q: D+ W謝謝各位大大囉
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2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file
" Q; r! w' x8 K/ g& Y先vi model.map file9 x8 p. |. A! n0 r, d
M PCH  .   .
! C- J1 G! E  jM NCH  .   .. |& v. @6 U3 @5 E/ A; w
第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,
5 w% J. k+ T5 P, j% q: e也就是說沒有自建layout 如下:
1 s  }8 p1 _5 E; K7 r5 i# J' D7 oM PCH  .   PMOS8 f8 F' p: V. d9 |. V
M NCH  .   NMOS
4 y; i- I% v0 K; U# D3 F如有自建layout library( Z8 j7 p+ }% h' O7 k
M PCH  lib_name   PMOS5 u/ P( u1 w8 R0 L3 m
M NCH  lib_name   NMOS
4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:
+ ^, f5 S: M3 Y1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.
& u- _4 n; I5 U3 y4 x2.  Syntax for Specifying Device Maps in a Device-Map File:
: R1 j# d, ^7 U5 i4 D     devMap := <primitive_device_name> <mapped_device_name>& E# Z. K& K& p1 ]; m+ Z- c
     [ propMatch := list_of_prop_to_match ]) \8 B/ [0 ?% \0 }
     [ termMap := list_of_terminals_to_map ]( e1 h6 {% u2 W  X, B
     [ propMap := list_of_properties_to_map ]
0 X; G3 o7 v3 t# S- r4 u3 N; `. S     [ addProp := list_of_additional_properties_to_map ]
+ d* f+ H  t3 N" _0 m& R- k      Example:
; R& f7 v1 ]- V  Z+ N      devMap := resistor res4 ?* Q+ }+ u$ }5 Q$ y$ w: [
      propMatch := r 20000& h7 P5 K- _7 f8 D: e7 A1 W' E3 G$ ]4 ]
      termMap := PLUS PLUS MINUS MINUS
) f/ D. `( _) F) ?3 ]" p      propMap := subType type r resVal w width l length; c. H9 E) g; g/ ^
      addProp := model res
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