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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file
' }+ r5 i4 t+ D, s( k請問reference library指的是??
' t4 F0 @4 X) N3 R. b8 x以及可以請教如何撰寫device mapping file嗎??
) G, }9 F' K- Z; B: I+ ~
% H2 m" C/ s2 ~( [6 h謝謝各位大大囉
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2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file9 j9 N7 ]9 ?+ q: t
先vi model.map file2 N$ l4 {- M: h' \
M PCH  .   .
9 d, y2 M! Z8 n! `6 d* UM NCH  .   .! E8 Y# v; [: M
第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,1 E; E; q, m6 n( Y3 I. j4 n
也就是說沒有自建layout 如下:
2 t9 v2 {8 `6 E- \/ A2 fM PCH  .   PMOS
( y6 ?8 _  t- `" g( E$ L6 g; g1 C5 cM NCH  .   NMOS
9 U$ D6 B2 Z. q  {如有自建layout library
. q; }! Q% ~# {1 H4 gM PCH  lib_name   PMOS7 H2 M7 f8 A3 e) x
M NCH  lib_name   NMOS
4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:
% i( W& R- D8 J  M1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.
  V+ R: c' z' O2.  Syntax for Specifying Device Maps in a Device-Map File:6 A4 q4 V+ ^% A& ~
     devMap := <primitive_device_name> <mapped_device_name>
' ]7 K+ }- c3 V5 D- _; f     [ propMatch := list_of_prop_to_match ]) C( c" r3 C8 ]2 w4 R4 f
     [ termMap := list_of_terminals_to_map ]
+ m: Q& m) W. r7 Z1 q' ?     [ propMap := list_of_properties_to_map ]; V4 j! {" I# y
     [ addProp := list_of_additional_properties_to_map ]
/ ~) u; [, E) q" a( R4 n      Example:7 P' q+ o* ?' C/ F" [" I) o" f
      devMap := resistor res
: E2 \$ m4 R  }+ W% s1 ?0 x8 G6 x7 a9 C      propMatch := r 20000
- w/ v! `; _- j* h  }7 d/ R2 }      termMap := PLUS PLUS MINUS MINUS
4 ^3 J/ C. e% b8 i! h9 d      propMap := subType type r resVal w width l length4 N# ^% u: E/ F0 Q! h; G
      addProp := model res
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