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[問題求助] 關於下線的問題

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1#
發表於 2010-5-13 17:52:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
近期可能要下教育性晶片,但是看到教育性申請須知與說明上頭寫了一段話
8 W; l# i9 `0 N% |& G! R
# h1 v$ d9 Y7 M5 _; u3 ^6. 繳交檔案及資料:1 F' F& T! r2 B1 d
申請人必須於申請截止日P.M.17:00前完成下列1) 至3)項,繳交資料不全者、逾期者皆不受理。7 K& w) R2 W, l  V6 T
1) 請ftp 技術資料:
- R5 z" {6 E/ X/ g7 ]$ G[1] 佈局檔
* e- M: I5 m. W2 q/ l[2] 佈局驗證結果檔(DRC、LVS或Apollo驗證結果檔)# y4 E# ?& @; {& _
[3] Tapeout Review Form。" w3 s% a7 Q2 d( n' z( K- G
註1:不可使用cell library。" k# J) S( ~3 v! E/ _1 v5 X
註2:佈局檔案上傳完後請上傳「OK」檔,以檢查上傳佈局檔是否無誤,並至晶片上傳檢查系統網
; A/ y; H5 Q: D4 z頁: “http://www2.cic.org.tw/~shuttle/chipworks/ ”以確認申請是否成功(若網頁上無其上傳資訊者,5 n! ?3 E$ t# \( h) {5 L
視同無申請)。
9 B+ \$ ~' ~; M% `4 [3 P4 h7 _) u6 ~6 I0 a* X
紅色的部分還不太懂它的意思,是說不能用tf檔裡面的cell,還是連自己畫的cell都不能叫出來用?5 F* q8 L' o! [; |) Z4 H9 F
麻煩幫我解答....
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2#
 樓主| 發表於 2010-5-14 11:47:12 | 只看該作者
前輩可以幫忙解答嗎; y! J+ f+ P! d6 t3 M
( u; c4 h+ L( n
真的很急...
3#
發表於 2010-5-14 19:05:35 | 只看該作者
是指不能用標準元件庫 (Standard Cell Library)
" b( U7 _$ D% T# {6 @+ ~用全客戶方式去下線就對了
4#
發表於 2010-5-14 19:28:20 | 只看該作者
意思就是所有電路 包括邏輯閘都要自己畫就是了
6 l$ \* v% f) O' D# j2 H! Q# Ofull customs bottom up design
5#
 樓主| 發表於 2010-5-14 20:39:08 | 只看該作者
非常感謝~~~~你們的解答
. a- z; r) z# d4 C# u* B
3 C" D% x8 @: U! L- k: K: J那自己畫的CELL可以叫出來用嗎?
6#
發表於 2010-5-15 00:49:58 | 只看該作者
自己畫的當然可以
# e+ f" t/ [" r/ D4 s它的cell是指 CIC 或TSMC幫你做好的cell. Y! U# A6 }/ E4 K2 ?+ b) E
因為是教育性晶片...chip size跟gate counts 都不會太大
6 o) k& `2 Y- a+ r4 K9 f3 n. a) l所以他希望學生全都自己動手0 j+ l: X6 b+ [+ f/ s; D9 g
PADs 則可以使用TSMC或工研院提供的cell- {. O' N( W* R7 H
只是不能違反它的命名規則
! a9 Y) h/ q# e* P- V前瞻性晶片就可使用cell library 而且面積沒限制
7#
 樓主| 發表於 2010-5-15 01:48:03 | 只看該作者
回復 6# shangyi
1 G3 m4 X$ E  {- b; L2 m6 a; K3 |- j3 ?1 Z
恩~我了解了~~~非常感謝前輩的指導
8#
發表於 2010-5-19 17:14:45 | 只看該作者
原來是這樣~~了解 又多學一件事
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