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[問題求助] PNP-B J T => LVS認不到...

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發表於 2009-10-3 22:03:36 | 顯示全部樓層 |閱讀模式
5Chipcoin
請教各位高手
: a' d" h5 U5 Z: T3 Q  P4 {製程: D35
& z: t' x! L9 }) K$ J, K元件: PNP7 S8 @3 d6 q& ]0 L  C) n
個別跑LVS時都可以過# C' {: ~7 n& Y: T
可是兩顆放旁邊時LVS則不會過 有人可以幫我解決這個問題的嗎?
7 q6 t7 Y' H% ?2 S$ r& W雙方的B腳是接地端
. \0 z! g! L4 A- o另外也請解釋一下這是什麼原理 為什麼不可以這樣接. |' k# k4 d; m: M  ^
我最後是想要實現底下的串接法~5 x) Y7 t3 E# Z
感恩
( d3 H4 c% i* z: w. S& k5 C4 L
! D; K8 T8 E' |. E1 s4 x[ 本帖最後由 layoutarthur824 於 2009-10-3 10:14 PM 編輯 ]
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以上大大說的都沒錯 不過卻都沒針對D35的製程回答,只有說明為要用什麼東西 這樣並不能快速解決他的問題 上面其他大大回答的我就都不贅述了 BEC腳仔仔細細的看"馬的"檔一定會寫到裡面的一些製程檔 我看到了你ㄉ問題了 加油 我也遇過這問題 還有一個方法就是 LAYOUT畫到會過就好了 如果不行不要用這架構了 這擺明是不能的 請換架構 我跟上面大大回答的ㄧ樣 D35不行用你那個架構 ...
發表於 2009-10-3 22:03:37 | 顯示全部樓層
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 樓主| 發表於 2009-10-5 04:54:20 | 顯示全部樓層

這個是我提出的問題詳細說明

以上可能是我問題問的不是很清楚
* o+ m) X* d# N這個是我提出的問題詳細說明# d2 g& o! f" P; o9 ?2 `
如副檔請各位高手幫個忙囉1 ~  }' R+ P+ V4 t/ B! |3 t
謝謝6 A& M6 y% {- E; R2 k# ~) H7 Y

& E3 _1 M4 u( R- E7 j3 d[ 本帖最後由 layoutarthur824 於 2009-10-5 04:55 AM 編輯 ]

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發表於 2009-10-5 09:52:19 | 顯示全部樓層
難以解的問題" \1 @2 \1 A; [( A+ U
有2個方向來看 4 W; t5 [- p+ m. ^( |# [
一方面可能是 你的 netlist pin 腳 對應問題: B6 K2 B$ y; k7 h+ N5 C
從圖看來 有箭頭ㄉ是 E  中間 橫線接地的 是 B 而另外一邊是C
$ Q, k* o$ I8 v看看你ㄉ layout 與 netlist 是否市 這樣街ㄉ
2 x9 V! d6 B9 E* S9 [4 n, `4 E由於P+ 會透過 P_SUB 連接 所以現在多用 一個 PSUB2  來區隔
5 {/ _  @) ?% m3 X( ^  P) R" S3 ?用N_WELL 隔離 也有 相同效果* F  B' L: i4 \9 ^) D  d) m  c8 N' X
0 ?* q8 O! P9 V! a+ o+ Z. E
一是  command file 你ㄉ BJT 是否有加 bjt dummy layer $ c; @2 N4 J; B* ^0 x
如果沒有可能會形成 自然ㄉ BJT 導致 LVS error
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發表於 2009-10-5 16:30:13 | 顯示全部樓層
CC是P+所以跟GND不可分,除非每一顆單獨ISO才能串接.
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 樓主| 發表於 2009-10-6 02:38:21 | 顯示全部樓層

回覆SKEEPY大大

除非每一顆單獨ISO才能串接.; G' R1 X5 J' ]8 s. k, N
你說的單獨ISO是指??$ `* ?0 u/ @" f( }9 Q. D- S% ^
D35串接PNP要怎樣才能單獨ISO呢?
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發表於 2009-10-6 09:46:30 | 顯示全部樓層
外圈的 psub(C0,C1) 電性上是只能接到gnd.除非你有twin well,也就是有Pwell 把C0,C1 端隔開(即ISO)才能都認到.
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發表於 2009-10-6 23:02:33 | 顯示全部樓層
一般製成都只有一塊地(sub),一般就是用psub2騙過LVS,那只是區分GROUND,實際上所有地都接一起(也就是0電位,透過sub都接在一起),不然ERC會有SOFT CONNECT ERROR
3 m1 |4 t0 z4 w& k  \; L- O/ Z" R0 T+ C! t8 K: g/ [1 @- m( P) t
你要那樣接LVS還是可認出來(要看command file怎寫的),但是會有ERC ERROR(SOFT CONNECT),實際上是接錯C0會透過SUB接到C1,若是蓋上PSUB2,LVS會對(騙過他),可是那顆IC做出來應該就不work了.
6 V) I' r6 Y- i( e5 d2 n9 l5 W; y. }3 ^( ?  x! q# V" X4 j
假如製成有NBL或DNW或twin well才能那樣接,也就是能割出獨立的PWELL,就是會圈一圈nWELL,在墊一層比較深的同type的well(NBL,DNW,twin well),這樣就會割出一塊獨立的PWELL( ISO PWELL)' z0 z2 N( z8 N9 o: d
  N  o* X) ]8 }+ r$ _* f" b# `" Y. n
LAYOUT不是拿來就畫,文件看清楚,有空去看看剖面圖,command file.
; r6 A) K; A* A1 J4 \
9 K5 {( q1 i; _! Y% B7 [5 m3 [, Y  v% \[ 本帖最後由 12345 於 2009-10-6 11:38 PM 編輯 ]
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發表於 2009-10-12 17:58:31 | 顯示全部樓層
是dbh035么,用DNWELL OR DEEPN 和nbl隔离起来,不然啥招都没用
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發表於 2009-10-13 09:39:49 | 顯示全部樓層
没有单独的Well 隔离!
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發表於 2009-10-13 11:00:02 | 顯示全部樓層
原帖由 wiwi111 於 2009-10-6 09:46 AM 發表 ) k2 c& a/ E# n9 I, w7 `
外圈的 psub(C0,C1) 電性上是只能接到gnd.除非你有twin well,也就是有Pwell 把C0,C1 端隔開(即ISO)才能都認到.
6 n2 W# C7 ]; X( d* M, j. S* {

; ^4 H* ^" {0 M上面大大說的很對~簡單來講~ 你BJT選錯了~你不能用這種寄生的BJT來做串接使用~ 建議改用垂直的BJT
; ]/ A1 F6 \+ I: l" |9 `% N這種的BJT 它的 C 端一定都是接在 P-sub ~ 所以就layout 來看所有 BJT 的 C 端 都會接在 psub 上
' g. m0 @' t! f8 y% ?7 G; z5 v你可以直接把你附的檔上的BJT剖面圖~都貼一起~ 你就會發現 P-sub 都是同一個區域 的, " Y3 E% D) {% G5 ^, q  r
誠如其它大大講的~ 不然你就得選那種製程是可以區分 p_sub 的 ~ 不然即使你使用 dummer layer 讓它認得到 ~ 最後還是不會工作的
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發表於 2009-10-13 14:26:40 | 顯示全部樓層
小弟借由 此問題 回覆請各位前輩們看我的說法對嗎?
  ^' A7 D4 Z7 v. T5 _
* M% U$ g' Y  S7 f如果 上圖我在每個BJT上 都圍上 NTAP  是否可行呢??: X# n' Z* f; i  ?  n: ^( J' R

8 {# \# q- q+ H4 Z7 _5 p5 S感謝
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發表於 2009-10-13 16:23:54 | 顯示全部樓層
D35到底是哪家的工艺,我为什么上传不了图片,难道是我发帖太少了么
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發表於 2009-10-13 17:44:00 | 顯示全部樓層
C极只能跟psub等电位,需要单独的pbody,也许需要nbl给隔出来,这个在纯cmos工艺很难实现了,是你们的designer对工艺不够了解,让你受苦了,不过你的cross_section 画对了,怎么没看出那些C极是软连接短在一起的
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