Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步,快速開始

Login

用FB帳號登入

搜索
1 2 3 4
查看: 11793|回復: 2
打印 上一主題 下一主題

[問題求助] deep n-well

  [複製鏈接]
跳轉到指定樓層
1#
發表於 2009-8-26 23:14:37 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我是剛設計rf電路新手,在設計好電路後layout時
) P; ^  a& \0 w; f$ y* v2 W; E, q/ Z/ F2 Y6 H7 O9 m! Z
發覺rf的mos最外圈有兩層,最內圈是body而最外圈是deep n-well% x; p* e' `3 w. O

; X7 i) E! i5 Y5 [9 L) Y我那時不知道那是deep n-well,而在layout時nmos那圈我都接地/ c. l; B6 _" G! t/ w
3 `9 V- l. f2 i* ^
而pmos是那圈是已經跟body那圈接在一起了,所以我不需要動它0 b: C' P2 x( v& _

. ~9 |' I1 ^  h* j& c8 m8 o6 C在我最近下線完後發覺好像不太對,我把nmos flatten掉才知道
/ I2 ?/ K6 t8 [; m& y+ M0 a+ v: B' [! W
它叫deep n-well,nmos的body是p型,那我還把deep n-well接地5 G& s2 r% F+ B0 Q) ]8 T

& q. e$ Y3 q  B/ u那不是有可能順偏,我電路中body都跟source接在一起,而我的電
, L: j+ s6 u& A& E5 e# Y% U: U+ |- P" ^% B. T3 M1 ^* D# ?
路中source又不一定接地,那這樣子我的電路很有可能不work嗎?
9 p$ f0 t2 X  i" z9 J' I9 d: ]* Q; L, E8 }4 G" q% B. R
deep n-well是一個電晶體配一個,還是整個wafer配一個,若是整個wafer
/ G+ S4 Z8 G3 Y1 W9 L
) b+ L. ]5 m5 l% I& M6 J一個的話那我叫出電晶體時怎會最外可以讓我選擇如何接?2 m/ Q  Z+ d' y# T
0 ^9 z5 j1 o9 q- P/ d* p
那deep n-well我該怎樣接才對?1.與body接在一起2.不要接(浮接)% {9 c" {: E4 I% _
* ^* v$ c0 T# X1 ^5 M" d
3.接到最高電位。那種方式會比較好,而一般會用那種方法?
5 z0 G8 }+ _1 J0 g: m' q8 M- \: j) c  c7 u% p/ V3 y
而我所使用的是.18製程。
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂81 踩 分享分享
2#
發表於 2009-11-22 16:24:00 | 只看該作者
我把這一篇推上來,因為我也有疑問,
9 X  k( u/ z, t* L% @# q! Z過去其它製程剛好沒有deep n-well ,現在用TSMC.18的model發現有deep n-well ,
- \* V" }8 J7 h0 Y- `/ v上課的時候說過這樣把所有的body都分開,所以可以單獨mos的s和b端接在一起,
' H4 {* f6 J  L5 w/ ^( ^. t: V可有違過去的經驗,雖為了怕bodyeffect而把sb端相接,
5 t: @2 ?  Q& Z8 U4 {  ~# j可怕latch-up,所以把b端都接最負電源,
& {: x, t0 Z9 }( H如今.18有這樣的製程設計,是否表示可以把sb端相接 ? 只要外圍有deep n-well ?2 R8 F+ T1 P0 L; I; e8 y
有先進可以回答嗎?
3#
發表於 2009-11-24 15:33:56 | 只看該作者
Deep Nwell就是为了实现sub隔离用的
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-5-15 09:04 PM , Processed in 0.099012 second(s), 17 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表