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[問題求助] 關於南科的邏輯分析儀Agilent 16903A

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1#
發表於 2009-8-13 15:31:01 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
請問若是我的flash adc的output buffer是使用open drain雙端輸出; c" o& A3 f- r# g
open drain的外接電阻應該估計多少(100歐姆或是500歐姆)
: _( }; P) T, B" N7 ]還有這台Agilent 16903A 可以判斷出差動訊號嗎?! E# o2 x( P. Q+ ]- n  P9 K
以下儀器資料摘自CIC網頁
/ f( b; T/ ]3 TLogic  Analyzer:  Agilent  16903A% R6 e$ X5 D7 a+ u) q1 w& ?$ A
Logic  analyzer  module:16760A
! a) Q8 X# f2 q, B2 zChannels:  341 P- Z3 {% q2 M4 X7 t/ k  s. E( C; h
Maximum  state  rate  (half  channel):  800MHz: G: _- B7 Y  h6 s8 B& Q) [
Memory  depth:  64M8 Z; o( w# q2 o3 h; H- d! G7 D
Maximum  date  rate:1.5  Gb/s8 g* ~* ?0 [& f
Support  single-ended  and  differential  signals: x2 n+ K( G; }5 O
Pattern  generation  module:  16720A. Q. Q' _: Q" O5 V
Channels:  48
' B7 b8 v5 _3 D8 g6 y) X; ZMaximum  clock  (half  channel):  300MHz( T+ ?1 E3 S% r7 z/ l2 W  t4 R
Memory  depth:  8M
5 n; V& A$ u" PLogic  levels  supported:  1.8V,  2.5V,  3.3V
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2#
 樓主| 發表於 2009-8-21 10:04:53 | 顯示全部樓層
南科詢問的結果是可以使用open drain的差動輸出) B; ]) u- u8 s7 t& v5 [1 [& m
不過還是不懂為何論文上不用inverter而要用open drain當output buffer
3#
 樓主| 發表於 2009-12-23 15:06:05 | 顯示全部樓層
請問有人知道模擬adc若使用matlab1 w' w9 h) Z- q8 {$ \4 r+ \9 |
要如何寫才可以使模擬結果接近量測的方式- O4 l6 E2 T) L% X  D0 ?
因為我發現寫法不同結果差很多. o! C- Y' d! `: o
取的點數不同也會差很大5 K9 E% m% t8 D: q3 C
請問應該取多少點才算準確又有效率呢
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