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[問題求助] 關於南科的邏輯分析儀Agilent 16903A

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1#
發表於 2009-8-13 15:31:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問若是我的flash adc的output buffer是使用open drain雙端輸出0 u$ h: ]5 ~8 r$ ^+ V
open drain的外接電阻應該估計多少(100歐姆或是500歐姆)
% n  w. U: b, F還有這台Agilent 16903A 可以判斷出差動訊號嗎?0 s  R& e/ b4 d" I' ~# \
以下儀器資料摘自CIC網頁( `+ ]" Z" V" u
Logic  Analyzer:  Agilent  16903A
! W% E. x+ q2 e& z2 }% o4 ?$ r$ c  v& LLogic  analyzer  module:16760A, p" H" L' ?/ t* s1 c# V5 G
Channels:  34
; _1 R: M! e7 h9 D9 l1 v& q% v, y- kMaximum  state  rate  (half  channel):  800MHz
. M' J# O$ ], Z$ {- d- JMemory  depth:  64M
- q) ^1 h, U* l$ l/ M3 ]Maximum  date  rate:1.5  Gb/s
) h9 b& F% [( Q! x7 L. P# WSupport  single-ended  and  differential  signals% r6 Z# n! }  Y2 n% a! y
Pattern  generation  module:  16720A/ Q' o: B; C. o& W/ A* G
Channels:  48
( u4 |  E# o9 l2 G, B7 y' VMaximum  clock  (half  channel):  300MHz
  i" D& x% o& C2 U) R( Y. KMemory  depth:  8M2 M3 T  h6 T/ {. @
Logic  levels  supported:  1.8V,  2.5V,  3.3V
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2#
 樓主| 發表於 2009-8-21 10:04:53 | 只看該作者
南科詢問的結果是可以使用open drain的差動輸出
7 B, e/ ]# m# [- n  y9 \8 X! `9 @不過還是不懂為何論文上不用inverter而要用open drain當output buffer
3#
 樓主| 發表於 2009-12-23 15:06:05 | 只看該作者
請問有人知道模擬adc若使用matlab
7 i5 ?, I2 \7 s7 V. O6 Z7 B1 o0 X9 W要如何寫才可以使模擬結果接近量測的方式) [& D  j! y% z# k  W  y0 [
因為我發現寫法不同結果差很多( m. q, X& L% F) e
取的點數不同也會差很大# M' i+ n9 p7 {% d5 J$ c6 y( r8 ^
請問應該取多少點才算準確又有效率呢
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