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[問題求助] 關於南科的邏輯分析儀Agilent 16903A

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1#
發表於 2009-8-13 15:31:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問若是我的flash adc的output buffer是使用open drain雙端輸出5 F' ^3 ?# P" S4 t
open drain的外接電阻應該估計多少(100歐姆或是500歐姆)
! X  N, t, H. Z2 J- N; R5 a3 [還有這台Agilent 16903A 可以判斷出差動訊號嗎?5 f# w7 C' s/ B* K: D
以下儀器資料摘自CIC網頁0 ?- R( U( t6 e7 P. T& P! k
Logic  Analyzer:  Agilent  16903A
+ w. B+ P- {/ U: q8 E9 n: XLogic  analyzer  module:16760A
: G: ]: q4 f: Y1 dChannels:  34& W5 R/ B5 z2 K% h! I3 h. z
Maximum  state  rate  (half  channel):  800MHz
  N# o" h$ d8 r0 X, C8 ZMemory  depth:  64M
5 x0 Z+ Q7 v& N" R- d! r3 pMaximum  date  rate:1.5  Gb/s
4 i$ d: n9 D9 X! ]0 c! K7 bSupport  single-ended  and  differential  signals5 C4 J% m$ e2 r( p
Pattern  generation  module:  16720A6 k2 W5 u4 L1 r* L  p/ P/ i* v
Channels:  48* ]# F( N# f0 V3 G
Maximum  clock  (half  channel):  300MHz
8 `2 X$ Z4 z; o, k: KMemory  depth:  8M: M% B! f& Q1 e
Logic  levels  supported:  1.8V,  2.5V,  3.3V
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2#
 樓主| 發表於 2009-8-21 10:04:53 | 只看該作者
南科詢問的結果是可以使用open drain的差動輸出
. ~# q4 T9 i" @: G) B4 T3 W. j不過還是不懂為何論文上不用inverter而要用open drain當output buffer
3#
 樓主| 發表於 2009-12-23 15:06:05 | 只看該作者
請問有人知道模擬adc若使用matlab; c& E& `' s" ]% }
要如何寫才可以使模擬結果接近量測的方式: Q/ t$ X! O  o9 |
因為我發現寫法不同結果差很多* {( L) z) C( S
取的點數不同也會差很大2 }; T7 k, F# Q5 L, h
請問應該取多少點才算準確又有效率呢
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