Chip123 科技應用創新平台

 找回密碼
 申請會員

QQ登錄

只需一步,快速開始

Login

用FB帳號登入

搜索
1 2 3 4
查看: 8361|回復: 7
打印 上一主題 下一主題

[問題求助] 畫schematic應該用已建好的symbol組成,還是電路完全用schematic畫較好?

[複製鏈接]
跳轉到指定樓層
1#
發表於 2007-10-28 23:50:38 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
小妹目前使用composer畫schematic,而目前是畫8bit全加器,同時發現到在畫schematic過程中 可以直接加入 事先建好的1bit全加器的symbol,就利用symbol快速的畫完8bit全加器,於是開啟這schematic來看電路圖時 所看的到只有8個全加器的symbol所組成。不須要特地畫1bit全加器的schematic ,然後再複制7個 ,最後將8個連線 接一接!
, ~, n" t* A1 [, P* F- K7 u-------------------------------------------------------------+ g' _0 I. j% p2 n8 @6 I
而小妹畫schematic時 ,直接叫出8個全加器的symbol相接,結果跑spice時 輸出訊號的波形很亂,所以 以symbol組成的schematic畫法在認知上 那裡有錯 並不是很清楚?
' e8 T8 K) G) v0 S- R! ]% q
: N' A/ @# ?. o9 I" m& |+ W現在小妹主要想問業界的designer交給佈局者的schematic電路圖 ,是否都是完全用schematic組成的?或是都用symbol組成?1 D1 P( [# v9 d
如果交給你的電路圖 裡面全是symbol,則佈局者不就得自行另外 畫成schematic的電路圖?! G" ]& i7 Q8 D$ r! e
關於這點 畫schematic 習慣由symbol來組成 還是由schematic來組成  ,請問是看designer個人習慣嗎?5 W4 F0 W& w1 C; A" g; e5 ?
/ Q* J6 w# T% r" M
麻煩大大若有空時 能提供經驗 概況 讓所有初學者能了解 謝謝唷^^
% F- I6 s7 {( l8 X* T' a畫schematic有2種畫法,一個叫出symbol來畫、一個直接畫schematic (但電路看起來很大)
1 S" s/ z5 l. q# [" ]) O: @) @2 `4 n) ?: e# l
[ 本帖最後由 君婷 於 2007-10-28 11:51 PM 編輯 ]
分享到:  QQ好友和群QQ好友和群 QQ空間QQ空間 騰訊微博騰訊微博 騰訊朋友騰訊朋友
收藏收藏 分享分享 頂 踩 分享分享
2#
發表於 2007-10-29 09:17:33 | 只看該作者
2樣都給.
6 s0 ~9 F* [% _" h最Top level 給 Symbol 9 U" |3 |! d4 I; _
但每個symbol內的電路也要給 layout 工程師
3#
 樓主| 發表於 2007-10-29 11:22:15 | 只看該作者
謝謝shag 大大的回答^^# `+ P8 \/ J/ L+ B3 l) R
同時似乎又說明了designer給layout 工程師schematic時 還有指定那一層要畫什麼電路嗎?: Q7 y4 s+ b* E, w  q) F
所以會給每一層要你佈局的schematic 而最 TOP Level 只給symbol 另外 所有symbol都也給其schematic 是吧!
+ p3 j& o; u; p) a! W. A2 X9 Z8 @' @# S! m5 @/ s6 l
如有錯誤 麻煩請糾正 謝謝唷^^+ Y, H5 B2 L/ V/ r& x* p1 \9 a, W5 z
designer交給layout工程師電路時可能還會指定那層要畫什麼電路,於是給你該層的schematic
4#
發表於 2007-10-31 20:43:51 | 只看該作者

回復 3# 的帖子

一般schematic與layout 之cell作對應,所以layout會依照circuit中的schematic name作layout cell name。
5#
發表於 2007-10-31 22:16:39 | 只看該作者
最好是用hierarchy的方式, 有現成的symbol就用symbol, 一般會把nand, nor, not, xnor gates...等等做成standard cells, 劃schematics時就可以呼叫那些symbol了.: b" t) p2 E) U9 U1 @
. c5 H* `+ |0 Y- c  w
這樣的做法會使得電路看起來簡化很多, layout designer 在看圖也較不會吃力.( k2 W1 J2 I1 P4 X

' e/ s9 a. B8 D至於這樣的做法是不會影響妳的simulation.
6#
發表於 2007-11-6 15:31:12 | 只看該作者
我想前面的大大都已經說明得很清楚了( {- N" @8 S6 B. d
一般來說到top 都會用symbol了! p- U* E0 W6 x5 ~) }! {
不然會畫到瘋,XD$ g  K' F  Q" v! M, U" I
8 B# m+ H. M8 d: l
至於您所提到的波形很亂不知道是什麼意思' a; o( y5 ~4 E! C" |' Y' A
您有利用別套軟體來看波形嗎?
3 r. O. W. J, Y' R5 s# E, Q( A因為加法器算是蠻多bit數了~  k) @; n  i' S/ ?# j! w9 M9 S
用那種可以把x和y變成bus來看的軟體很方便許多(nWave)
1 w( t5 m! l+ G+ s% X3 a9 `
* Y) F( k) F+ X/ {我猜您所說很亂的意思不知是不是狀態有些地方不正確
( ~* Z  u/ l) n+ b如果是的話,應該是glitch(假性switching)所造成的. [4 I+ ?" Z: q; M1 f
這只要將mos的size 調過之後就會減少這些現象了& B4 [# m4 b/ e5 L
一般來說學長姊都會叫後輩用1:2或是1:3 (nmos:pmos 的width); ?6 ?! m8 G" V: i# w4 l: H0 M
不過實際跑過之後會發現大概是1:2.x 要看製程,小弟只有摸到點18而已~"~
. G: S  u! d8 u試著將size最佳化看看吧' J! i* ^* b2 d- D5 i6 s
不過我記得假設是傳專題的話,應該是不用最佳化- ^' j0 ]% |7 U1 V
因為只是要驗證所提出的架構,比標準式的好而已~(類似)* |0 s% }" R* }  N( c- k$ }

5 {" n4 \1 ~. ~$ p以上參考看看
7#
 樓主| 發表於 2007-11-6 19:48:06 | 只看該作者
樓上的大大謝謝你的建議!. o7 K- j' A+ Z5 m
小妹我使用的是cadence tools工作站 ,而小妹畫8bit全加器 乃叫1bit的symbol出來畫的,而跑pri-sim時波形很亂 ,應該是電路也許有接錯! 我不知用symbol組成的schematic是否與 整個電路真的就畫很大的8個位元的全加器組成 是否方法有不同?那裡有需要注意?0 ^" u6 }: S4 P# K1 H6 J/ _, q
因為後來小妹自已是畫了1bit的schematic ,然後再複制7個 自已慢慢的接成8bit ,然後跑pri-sim波形就正確沒問題!
0 f! u. E7 W: U& z: f. ^  V倒是想請教您^^  用symbol來組成 與用schematic組成的 電路圖畫法上有需要注意的地方及差異嗎^^  我是用composer畫的!   謝謝^^
. J" w9 B4 t2 e; S4 N另外我用tanner tools中的S-EDIT  畫schematic時 其中都叫symbol來組成,其實跑pri-sim都沒問題呢^^+ V; r" i9 O  r: O' M
不知是不是virtuoso叫出symbol來組成 ,在畫法上有要注意的地方呢?   =  =
2 x' S5 e5 F( w3 v5 a1 M" L3 m- m' B  P6 @) m
[ 本帖最後由 君婷 於 2007-11-6 07:51 PM 編輯 ]
8#
發表於 2007-11-6 21:45:10 | 只看該作者

回复

好像没差吧?symbol得连线也是一样连的啊,不过有可能你symbol的电源和地线没连好。
您需要登錄後才可以回帖 登錄 | 申請會員

本版積分規則

首頁|手機版|Chip123 科技應用創新平台 |新契機國際商機整合股份有限公司

GMT+8, 2024-4-28 02:10 AM , Processed in 0.118006 second(s), 17 queries .

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回復 返回頂部 返回列表