ARM Cortex-M0/M3 Logical Validation Implementation

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├─doc
│  ├─Cortex-M0_TechnicalReferenceManual_Frame
2 o4 ~! `  \6 c0 Z3 A│  │  └─graphics
│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
│  │  └─graphics
+ [. \* P/ a* A1 L# P4 R│  └─Cortex-M0_UserGuideReferenceMaterial_XML
│      └─graphics
7 L0 x# _& Z5 r, i8 O& N8 L9 r├─implementation
│  └─vectors
5 w( v8 P# K- \& B│      ├─CORTEXM0IMP
$ `' a; f5 {( q# l- M( X/ g│      │  ├─crf
│      │  ├─srpg
5 M* T! Z2 x8 O7 L+ w% p0 L# S│      │  └─tbench
! F! V7 L% _3 S5 ^3 t. O' B│      │      └─logs
│      ├─CORTEXM0INTEGRATIONIMP
, A0 |5 F: r4 d4 n4 n" |7 E│      │  ├─crf
│      │  ├─srpg
│      │  └─tbench
│      │      └─logs
│      └─tools
1 R; ]: D- D7 w: x, w) {│          └─VerilogCrf
% [( s9 d) [! Z0 [" I# U( C├─integration_kit
& ]1 `* z% L. t) [3 a4 W; d│  ├─logical
7 b2 P' X8 e5 H7 R; u$ d│  │  ├─cm0ikmcu
, i& S& A0 K; h9 }0 _$ v* |: v8 P- F│  │  │  └─verilog
│  │  └─tbench
│  │      └─verilog
4 R8 V) @0 d4 n" l0 c3 P│  └─validation
│      ├─glogs
! `! o7 U  Z! E' ]! n│      ├─logs
: _, f/ y: D* i6 k0 B" Z│      ├─mdk
! y6 `- t* N" L! d; H│      ├─srpg
* Q$ d0 _: A" d! S# }│      ├─tests
. p2 d) L9 G$ t$ N│      │  └─CMSIS
" t& D) B8 W9 m, F' ]5 ^/ ?/ x; q, o│      │      └─Core
│      │          ├─CM0
5 U" Z6 t. i; ~. U  v! `│      │          └─Documentation
& N: y$ R# I6 |4 d3 ]5 S│      └─vectors
├─ipxact
│  ├─busdefs
# W8 I; k3 l6 O* X- D│  │  ├─amba.com
+ r1 |  j" v9 F/ Y6 l7 s7 w│  │  │  └─AMBA3
│  │  └─arm.com
6 r" b( c3 ^& j. k│  │      ├─CoreSight
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; C5 c* J5 f' j& Q; g0 D- ]│  │          └─rtl
/ w( X; U, i6 a; M│  └─components
4 ~9 ?3 L: U6 J& O│      └─arm.com
│          └─Cortex-M0
" }- [; j$ g8 V4 c# Z, P└─logical
    ├─cortexm0
    │  └─verilog
; g2 K  S/ y6 }5 q& N    ├─cortexm0_dap
" U. @5 v9 C- l4 L0 j    │  └─verilog
! Q7 K$ C" C2 f( q0 x    ├─cortexm0_integration
    │  └─verilog
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: `2 n( R* l& }" B" \8 K    │  ├─upf
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    └─ualdis
        └─verilog

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├─AT420-DA-03001-r2p0-00rel0
+ G& ?# V* C/ R+ }5 d│  └─docs
4 W9 N! l+ t  Y7 T) g* G│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
. j, b3 e+ Q5 j│         
) ~/ b& v" ]& f9 w$ Q! G├─AT420-DC-13001-r2p0-00rel0
0 Y' }: O) s, B. k9 g1 b0 F│  └─docs
. A9 E& n6 d) z
│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
- O6 R6 i! ^' j│  │  │          CM3ROMTable.v
* ^1 J5 H6 g8 }0 j│  │  │          CortexM3Integration.v
│  │  │         
│  │  ├─dapswjdp
- k/ q( P: Q( I6 U; i│  │  │  │  README_DAPSWJDP
│  │  │  │  
, E- A% A. A% E/ o3 U│  │  │  └─verilog
& s1 ?7 x: Z% N) o9 i1 t2 |& ^│  │  │          DAPDpApbDefs.v
! `7 z  I( T4 V( h! w/ `│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
! Z* ~1 z3 g/ Q│  │  │          DAPDpClamp0.v
; E" j, U/ f% g- w; R7 F. |$ O│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
2 E' M/ P+ z9 k6 Q* s│  │  │          DAPJtagDpDefs.v
% p& A! {) f& ?5 Q6 J" ?: o│  │  │          DAPJtagDpProtocol.v
3 \$ u1 F$ E4 ~4 v│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
5 @( [' ^7 b6 E│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
" t, Z: q: y' X' r7 [│  │  │          DAPSwjDpDefs.v
& l) _7 S. L, Z" j│  │  │          DAPSwjWatcher.v
- [/ Y; m" Y' D" p- Z2 v│  │  │         
+ l# X+ _3 y# u/ }- O│  │  ├─models
│  │  │  └─cells
* }+ {9 Z, Q1 h8 S. y4 r1 {│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
3 S7 g3 A6 L5 W9 Q! `! j8 a0 {│  │  │          CM3Sync.v
│  │  │         
' C2 h# ?% p" |( N0 F9 x│  │  └─tbench
0 n: M5 ?! r2 S/ H│  │      └─verilog
│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
# R. c( s) p& W8 p0 b& ~& g│  │              CM3BusComparator.v
│  │              CM3BusGasket.v
4 V; L% l8 M. l# B│  │              CM3TestExAcMnAhb.v
│  │              CM3ValAHBSplit.v
│  │              CM3ValApbTrickBox.v
│  │              CM3ValBusCompareCtrlReg.v
5 c" J5 I- S2 Q2 r1 w6 D+ J│  │              CM3ValControl.v
│  │              CM3ValDebugCore.v
' Q0 k$ ?4 F  t+ r│  │              CM3ValDualPortRAM.v
│  │              CM3ValDualPortWrapper.v
│  │              CM3ValETMTrickBox.v
│  │              CM3ValHTMTrickBox.v
, s) B, O; x9 Y9 `│  │              CM3ValIRQGenerator1.v
│  │              CM3ValIRQGenerator2.v
" C: R: E" B  e. X, p' O, f% P/ Y# O│  │              CM3ValJtagTrickBox.v
: _5 R) O/ P, y7 j& v│  │              CM3ValMemory.v
│  │              CM3ValPMU.v
│  │              CM3ValRAM.v
│  │              CM3ValRAMWrapper.v
│  │              CM3ValScratchPad.v
; o& S; D0 l0 B4 c8 h6 Q+ H│  │              CM3ValSWCapture.v
│  │              CM3ValTBDefs.v
! A$ }5 X9 k9 N* U│  │              CM3ValTraceOutput.v
│  │              CM3ValTraceSync.v
& O/ X* k* L4 {) Y$ J1 C
+ N8 H; e- _! {6 w8 P* ?) Q│      │  │  exclude_list.sc_waitstate
' @& @0 |- k. f+ d% u
2 Z6 d! g) r6 d" Z! \% e1 `& v) `3 ?            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
5 F7 b5 J9 D* _  }( X, Z  J8 k) J            │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
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' s$ ~" L9 Y1 Q! Y& {" m            │      │  
            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
            │              cells_1.geo
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: Y/ d4 ^9 @2 _6 c, ^            │              index.cli
            │              README.TXT
            │              rulesets
            │              VERSION.TXT
            │              vias_1.geo
            │              
' C9 n) _: H+ F% T4 C8 X, a, b' {            └─tsmc
+ t7 ~9 Q" F6 u: j/ c. x( e                └─t-n90-lo-sp-002-f1_1_6a_20060914
                    └─6X2Z
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