brief for Cortex-M0/M3 Logical Validation Implementation

sinoicboy

├─doc
+ o/ |) V, H# j3 V' C2 M│  ├─Cortex-M0_TechnicalReferenceManual_Frame
│  │  └─graphics
│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
+ S& G- T, Q0 b$ N6 j/ z1 G│  │  └─graphics
1 t+ e! p' b# S8 @8 q; A│  └─Cortex-M0_UserGuideReferenceMaterial_XML
│      └─graphics
├─implementation
│  └─vectors
│      ├─CORTEXM0IMP
* k8 j7 t. I2 ~, w0 m* J1 u9 N│      │  ├─crf
( _+ i; n# {: t( S' ~& v│      │  ├─srpg
5 [- f4 B" }  C; |│      │  └─tbench
│      │      └─logs
│      ├─CORTEXM0INTEGRATIONIMP
9 F  [" w" v. W' X! [, X│      │  ├─crf
9 f$ _0 y& n+ V. |0 S│      │  ├─srpg
' V! U4 `3 l! x/ c7 N( K! e0 \│      │  └─tbench
│      │      └─logs
- u* b% j! ]7 c: W│      └─tools
0 Q5 V; F( l! E- V│          └─VerilogCrf
! a% M4 D4 k! F# a+ }├─integration_kit
/ S6 N7 Z# e1 L1 ~3 N# k- ]│  ├─logical
7 A; ~( T6 e2 d- ]8 B0 X' C9 A│  │  ├─cm0ikmcu
  a, t! T+ j4 V9 ]4 t/ Z# P│  │  │  └─verilog
│  │  └─tbench
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4 V7 E5 D1 j+ I" H4 @5 w│  └─validation
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& W& j) B* @. T& f  X# L│      ├─tests
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│      │          ├─CM0
! H, P* N% J* s1 d* f+ h3 a│      │          └─Documentation
" L9 A7 n2 \( I│      └─vectors
6 V+ [8 P' R. [5 m├─ipxact
│  ├─busdefs
$ `2 ^0 r7 |, h# L│  │  ├─amba.com
│  │  │  └─AMBA3
$ H/ f) y3 [0 [/ m+ D# w│  │  └─arm.com
│  │      ├─CoreSight
8 w& \' q* ]. d4 m3 K, K6 j│  │      ├─Cortex-M0
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. b* A; Q4 ~7 S. A. \1 H│  ├─channels
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/ Z' ]& y* Y& H, U8 [│          └─Cortex-M0
└─logical
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    │  └─verilog
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- H: @( s9 t0 H9 ?    │  └─verilog
+ X" @) [/ m0 f5 Z6 J  e    ├─models
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2 N) i% U) d, ~" T' y# {    │  └─wrappers
    └─ualdis
: }/ q; C. _! s4 n/ Q3 h        └─verilog

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yumumu1991

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cjwei

The Future for the IOT, M0 and M3 will dominate the market.

jm2000

thanks~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~``````

jm2000

Chip123 科技應用創新平台

talrasha

thanks~~~~~~~~~~~~~~~~~~~~~~~~~~~
& p! w3 [# \8 ^! U) T

mdtjason

回復 2# sinoicboy
# B  E+ g/ d6 \8 _' c% a- l

8 S! ]5 j$ F3 k5 Q) T    thanks~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~~``````

sinoicboy

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
6 B* b; ]4 J5 A& V! ?│          DDI0337G_cortex_m3_r2p0_trm.pdf
: P1 \; [, O2 @# _1 t+ r│         
! B0 Q+ a# g/ Z├─AT420-DC-02008-r2p0-00rel0
│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
3 K/ ], Z. x" A& Z  w# K│         
5 L! V- P8 U2 p8 ^; g; i" \6 Z- l. x├─AT420-DC-13001-r2p0-00rel0
! ]; d+ p' Y* k% I5 a7 V4 r│  └─docs

7 ~+ z6 f+ V6 |) e, ~│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
8 W0 Z. |! E* }: Z0 T│  │  │         
% E; s' d3 p% Y- k│  │  ├─dapswjdp
& x8 \  i/ _) E( e" V, W│  │  │  │  README_DAPSWJDP
  W2 f7 {1 F  O│  │  │  │  
│  │  │  └─verilog
6 i# A' z2 p+ z" P9 l- |* B: |│  │  │          DAPDpApbDefs.v
, h' V  E% Q+ U  k+ K│  │  │          DAPDpApbIfClamp.v
$ e  R" ]% l, ?, A/ g│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
% j4 R$ e# H3 e│  │  │          DAPDpEnSync.v
6 a$ o( `4 e* K5 K  _( d8 `. _│  │  │          DAPDpIMux.v
' S; A) C/ t& j" I# }! i, g4 k5 t│  │  │          DAPDpSync.v
' r5 a8 P. F- M* V4 X3 \│  │  │          DAPJtagDpDefs.v
3 E; G9 O3 J; e/ _│  │  │          DAPJtagDpProtocol.v
. h4 I  G. l4 h1 [" Z6 p" K8 \│  │  │          DAPSwDpApbIf.v
1 i. U  C8 J8 a8 u│  │  │          DAPSwDpDefs.v
4 o5 \) l% P- k: @# q│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
1 r9 \0 U% S  D9 `' _0 M6 {0 u│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
" q! g1 `1 I; R' k│  │  │          DAPSwjWatcher.v
& h1 c% t/ E4 I│  │  │         
2 T. k$ ]8 D) L# }0 W; Q│  │  ├─models
3 E& S5 G% ^5 i9 u7 q5 B- \( i│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
│  │      └─verilog
" B; W7 n% {: ^" S│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
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' L6 V& \3 f; ^9 S( ]3 P$ B1 B: z│  │              CM3ValBusCompareCtrlReg.v
/ a, a$ z' e4 T! ~/ I* e1 O│  │              CM3ValControl.v
: q1 b, {/ u7 X* I0 z: f6 K: Y│  │              CM3ValDebugCore.v
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7 [) Z* H: L& i+ g3 l│  │              CM3ValDualPortWrapper.v
9 g' u2 ?0 c2 `7 {4 j+ @4 g# G3 [3 _│  │              CM3ValETMTrickBox.v
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. t7 ?; V! D6 O  `6 _6 S│  │              CM3ValIRQGenerator1.v
│  │              CM3ValIRQGenerator2.v
. K9 z* }& `- C8 k3 @# A. u│  │              CM3ValJtagTrickBox.v
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: g' c" w0 H9 g6 v/ a) u+ u: S$ Q3 y│  │              CM3ValRAMWrapper.v
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/ J4 z2 @2 |& B3 e│  │              CM3ValSWCapture.v
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│  │              CM3ValTraceSync.v
3 d. f. J( m4 s" K
│      │  │  exclude_list.sc_waitstate
$ o+ L( |1 E  J. |( L9 e
3 g0 G$ f/ s. C; E            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
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            │      │  
            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
1 Q" N: H) ^  U3 C            │              cells_1.geo
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) @8 g* P$ n7 g: [9 R3 {            │              rulesets
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