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[問題求助] 請教FPGA差動輸出的問題

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1#
發表於 2009-4-28 19:53:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
大家好: {+ `% R$ i+ ]* n0 v! t2 R$ V8 z# I
4 T, F! y) n9 `" g
想請問一下7 ]8 T$ I2 {1 d' h
- h- L4 n( b' S0 \, q7 U( ~8 t
現在我的FPGA外接4組driver IC% k$ c3 k/ B8 d4 {" w' @2 @
, ^1 c5 [" r& W$ W+ P, P6 ]. G
此IC為differential type的輸入. C$ [/ D; A  P. _6 Q. l* \: H
2 V: l1 Q& ?2 }0 R2 @( ]6 q" o

1 h! x( ~3 c. `5 l. A3 ?我現在每一筆控制data為4bits (期望能操作在500MHz以上)! m- }, e& |6 v; r( k8 q
2 {: ^4 O5 u9 O7 J
每一個bit分別同步控制一組driver IC9 ^1 M" G8 V" ?- `
, r  b/ d6 E0 J; {4 K  Z

9 z3 O) k" l2 T% W) A我想請問一下
# O) ?, H3 J2 y6 v  M6 n& E: U/ D" q- b) r9 O) G& i7 N' h4 _/ q
我想把每一個bit在送到driver IC之前
, b( ?/ O3 @) h1 T/ \( j" z/ M) v" p7 ]3 i( o5 ?
先轉成differential mode$ ~) i2 P4 F  m( c: j) M

: {, R9 M& a8 _9 f; s+ F0 O7 ?- r; q8 o) M9 w
我現在的想法是  E: {) W1 ~) O& F) o* m% |
! i: z/ |0 N) b/ v$ x3 d
寫個differential mode 的module; V! R2 {% I0 G, v/ p, H! n
( G0 F# I/ f2 h/ o
此module很簡單) C0 f: n- ]+ o

2 w1 W( R. J% A2 W為單一輸入
1 e( ~8 V5 g& J: e. q2 [- Y& _( ~: g- V% Z- z& Q$ N4 [; V) m- I' M
經過一個buffer 與 一個反向器# U; x1 u$ F5 @5 r) R+ ?9 [

1 V) M; k$ M# {0 @的雙輸出
1 z0 A6 C* ^) q* k
2 N* G( O' r0 N/ d7 @" p, y. k- |# P) w. s; x4 Y4 H
) X: l, F# A8 d
% @4 U9 v' O4 E7 P: V
感謝
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2#
發表於 2009-4-28 22:31:27 | 只看該作者
請使用DDR的IOB並把IO type設定成LVDS即可
: ^9 b7 `" r' B0 v$ j不需要特別去設計一個module
3#
發表於 2009-5-6 18:41:20 | 只看該作者
直接使用的話,skew 的問題要特別考慮
# C5 E' b/ c# F$ V( O* @另,一般 fpga,有現成的 differential io 可以用
8 L3 S7 k0 F* ], L4 o" K不過如果是 500 MHZ 的話,可能要挑一下了 ???
4#
發表於 2009-8-17 10:52:50 | 只看該作者
千萬不能這樣用& J7 c4 G; ]' Y/ }5 ^
在高蘋上面你必須考慮兩個部份
' ^+ l1 j" b) b- t8 `外部PCB必須等長" I9 L8 C) e; B5 \7 d
內部在LVDS buffer 之前的routing
1 j/ q1 b* C9 C# `+ i不然你會q到死
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