多大的Buffer可推動NMOS gate

hiyato

最近做了一個Clock gen，要輸入到NMOS switch的gate，發現輸出訊號不見，

! j+ y* v8 t- t& C8 d. j/ U懷疑是gate oxide的電容太大，導致無法推動，在Clock gen的輸出接上一組Tape buffer後，

NMOS switch 的訊號還是沒出來，不知道是哪邊出問題？煩請版上大大幫忙解決，感激不盡。

poseidonpid

1.你可以先觀察你加上的那一組buffer的每一級的輸出是否正常。
2. 你的NMOS switch是接到哪裡?? 電路畫出來勝過千言萬語。

hiyato

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+ }; z3 K6 ]7 {$ j% Q
% b' r& y" ~3 b: _電路示意圖，如上圖所表示，一個簡單的sample & hold的電路，
; B; S7 ?7 p3 ~0 ^8 Z- I# e標準電壓1.8V，Clock為理想Clock(rise and fall time =0ns；period=2ns)
9 w5 F1 A! N$ ?8 v輸入訊號sin wave (amplitude=+-0.1v；25MHz)
0 T  a/ f9 R1 T2 q+ b: x7 u- @在理想的switch中，輸出訊號正常。
在NMOS switch中，輸出訊號縮小且失真不正常。
* T7 C  h# [1 l! }3 h4 b& K取樣電容大概=400f F左右。
先謝二樓副版幫忙解答。

poseidonpid

1. 因為你的clock gen是用理想的clock信號給的，所以加不加buffer都沒差，(加了可能變差)
. g2 N: e3 k& N. B  |* A2. NMOS switch 在trun on時會等效於一個電阻，所以會形成一個RC電路 (即充放電)，因只開2ns，速度可能跟不上，不是將取樣時間加長，不然就要把NMOS W/L 加大，讓充放電速度變快。 (不過看你的輸出波形又好像已經到穩定??)

ansgoing

回復 3# hiyato


    學了一課.感謝大家的討論

blueskyren2001

学习一下，谢谢！！！！！！！！！

larrysky

又學習了一樣　　感恩!!!!!!!!!!!!!!!!!!!!!!!

hiyato

回復 4# poseidonpid

先感謝副版詳細解說，再試著調整Sample rate與MOS size試試看。

lilyyulan

又长知识了，不过还要回去分析一下

li202

為什麼要回應才能看到圖
這樣別人怎麼幫你回答

ysp500417

ok increase the width of NMOS ,reduce the value of capacitor

rice019

我也看一下電路的情形
7 \2 d8 t: v6 ]) Y% @" n2 V: z" b所以回覆一下

rice019

設計SWITCH時可以先跑一下RON的值
列成一個表
之後看表拿進去套用即可
3 m& |' b0 Q) P8 J: H此外此電路SH電容不大
. u' \0 H! r6 \" k& f' K: M會受到charge injection & clock feedthrought的影響也要考慮進去

xflying

回復 13# rice019

1 Q2 J6 U9 C) i4 V5 G
1 f# u6 E. T0 D: K0 t/ I, t: k    看下原理图，回复先，2ns  ~500MHz

winston5231

想看依下電路圖...方便了解

Malong

先看一下圖，幫助了解一下狀況，好看看有沒有合理的解釋

Malong

看你的輸入電壓和工作頻率，我猜你是想做Dickson Voltage Multiplier吧?
由於輸入電壓非常低為0.1V，且為Sine Wave，
在此一狀況下，輸出會被MOS Rds-on所損秏掉，
: X% L* a6 f) s1 W一般來說，Rds-on與W/L成反比，但是光加大MOS的W/L效果有限，且不適用!
看你輸入電壓為1.8V，想必是0.1um Process，
建議你改用Native NMOS，相信能解決你的問題。

anguschen0917

想看依下電路圖        ...

Zuman

为什么电路图要设置成回复可见呢？？
  }) O9 R0 `* k2 Z% y前面说的不错，应该调switch的宽长比，电容最好不要减小，以免误差增大

kj.guo

一方面需要clock的buffer 具有足够driving 能力，
另一方面一定要run switch的RON（一定要sweep 所有可能的工作电压差的情况）