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[問題求助] 關於南科的邏輯分析儀Agilent 16903A

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1#
發表於 2009-8-13 15:31:01 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問若是我的flash adc的output buffer是使用open drain雙端輸出" o' ?; ]# z% |# S+ i
open drain的外接電阻應該估計多少(100歐姆或是500歐姆)
; j4 A9 U6 q6 n; Y$ |還有這台Agilent 16903A 可以判斷出差動訊號嗎?
' B6 I2 j* I# z  c以下儀器資料摘自CIC網頁
" C% V$ v) `/ E  H0 f4 d; wLogic  Analyzer:  Agilent  16903A
0 o' v+ g" ?: [3 U4 N/ dLogic  analyzer  module:16760A" Y" A7 ~3 k1 \' \" h. z
Channels:  34% q! `* U4 U9 R! y1 _
Maximum  state  rate  (half  channel):  800MHz
: X9 a( i0 i- W7 I* `8 xMemory  depth:  64M
8 M! x2 \; ^4 nMaximum  date  rate:1.5  Gb/s4 \3 K* a& x$ V5 e
Support  single-ended  and  differential  signals3 o8 Q* M4 x0 j* v) t& h
Pattern  generation  module:  16720A, U) \3 E& B6 L5 W6 G
Channels:  48
6 o% W& J$ U6 G' |# v6 E! iMaximum  clock  (half  channel):  300MHz
. a1 J8 u. j* C( L& |Memory  depth:  8M3 T+ P) r7 d0 ?# t* a' u
Logic  levels  supported:  1.8V,  2.5V,  3.3V
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2#
 樓主| 發表於 2009-8-21 10:04:53 | 只看該作者
南科詢問的結果是可以使用open drain的差動輸出
7 j) L& i3 \- B' U0 g. x5 S, M不過還是不懂為何論文上不用inverter而要用open drain當output buffer
3#
 樓主| 發表於 2009-12-23 15:06:05 | 只看該作者
請問有人知道模擬adc若使用matlab2 q2 Y( U# X8 u; |' U
要如何寫才可以使模擬結果接近量測的方式1 k+ i& Q6 M: v
因為我發現寫法不同結果差很多
$ B8 G! k) E1 a% Y: U取的點數不同也會差很大
8 F" X8 Y8 V" j請問應該取多少點才算準確又有效率呢
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