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[問題求助] 一些Layout的問題

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21#
發表於 2008-4-3 20:19:53 | 只看該作者
关于 double guardring,我们的画法是 ntype ring 靠近噪声源
% f+ W, l6 Z$ E/ S+ e; S* t0 ^就是说 如果包的是噪声源的话,ntype ring 在里面,如果是为了防止别的噪声干扰的话,ntype ring包在外面
22#
發表於 2008-4-7 23:24:51 | 只看該作者
非常感謝大大的分享+ L' B( k4 c3 O3 E) h
非常感謝大大的分享
$ c7 s+ ]/ E5 d非常感謝大大的分享
23#
發表於 2008-10-23 14:21:55 | 只看該作者
原帖由 finster 於 2007-9-6 10:31 PM 發表
' i* k9 t" v+ O% L$ ^' ^' n我是在一篇paper中看到的,不過這篇paper不知被我放在那裡了
+ h2 U9 ]5 b) B0 g" `* k, e6 H" v另外,你所引用的教課書的公式應是Razavi那本"Design of Analog CMOS Integrated Circuits"中第13章的吧$ H$ F. N; `$ T
書上是先決定BJT的顆數比,然後再求出相對應的電阻 ...

5 ^: Y$ T/ |2 G( ?9 J, b0 F! e5 |( X2 h( ]0 m
好像实际确实如此!谢谢! ……………………………………
24#
發表於 2008-12-2 12:56:22 | 只看該作者

非常感謝大大的分享

非常感謝大大的分享% N$ r$ N0 @6 N( ]2 E$ Z4 u2 y
非常感謝大大的分享" b" c7 P! b* Z( b2 z7 m3 i+ j
非常感謝大大的分享
% N5 o, M. |: G2 n; x; c7 S常感謝大大的分享9 d( m& N- f! X4 n4 i. L
非常感謝大大的分享
3 J* f# v( ~: O5 x) `非常感謝大大的分享
25#
發表於 2009-8-9 10:47:41 | 只看該作者
1    普通的logic电路影响不大,  不过一些高频信号, 一些delay电路等的还是尽量避免5 q6 h$ M6 R- z+ {$ m3 G

% k+ o% l0 m5 k6 d2 N) K' x2    guard ring 最有效果的是p + guard ring,  但是一定一定一定要接到干净的gnd!!!, 这样才能吸收掉noise。  2种都画的话,比只要p+ 好一点点。   j4 E6 D; q( x* y
5 A5 u. p! ?: J. W9 C4 N) X! x
3  这个是为了匹配这样设计的,一般都是设计成1:8    ,1:24 。
26#
發表於 2009-8-9 17:24:40 | 只看該作者
最近在做pll的電路。類比數位都會用到。8 e2 \+ r8 a( t2 i. K4 P. m
各位都好利害啊,每個回文都有參考價值呢∼∼
27#
發表於 2009-8-9 21:57:17 | 只看該作者
剛好要瞭解這方面的資訊,正好做來參考...8 K" q9 i" T( s6 D
8 `7 w. ~" H9 H  v! R
謝謝分享...
28#
發表於 2014-3-28 09:19:44 | 只看該作者
非常感謝大大分享~
8 Q, _% J. z' I9 S6 V2 @9 H非常感謝大大分享~4 {+ h: ]! {9 d
非常感謝大大分享~
29#
發表於 2014-4-23 16:42:21 | 只看該作者
2:pring 接地收集空穴,nring接高电位收集电子,二者纵向结深越深越好;多子ring是为了让sub电位不被拉高或拉低,少子ring收集电子或空穴
30#
發表於 2015-1-2 14:47:45 | 只看該作者
謝謝各位前輩的經驗分享
31#
發表於 2015-5-19 14:25:40 | 只看該作者
1! c5 ]! B, w! w
怕千擾
0 |3 k% T5 _9 p可以事先詢問rd care的地方,避免跨過即可
0 r" e( D' S% Z2' n9 ~# ?! P1 B
依pnmos來決定第一圈及第二圈ring9 P0 \+ w( K0 \9 Q" Q! w, I
3* U6 T, s% F5 q  T& ~  ]
我也是畫9官格
32#
發表於 2020-8-11 22:39:34 | 只看該作者
非常感謝大大的分享$ ^7 z) U/ k! N* q- K. R$ i/ S
非常感謝大大的分享  [5 t" ~; Q$ a+ V6 W( K! T
非常感謝大大的分享
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