請問如何設計BCD counter

monkeybad

如題
小弟我目前在設計一個時鐘電路 需要一個記數器 不知道這個問題是不是屬於這個討論區
3 L! x* @& L3 r! B如果不是麻煩版主修改一下囉
9 [+ L. L3 u! C
! v3 g- ?" v& P+ h9 a% z  H* h目前這個記數器要能數0-9 接著就進位 然後自己reset繼續從0開始 進位後訊號再繼續由一個0-5的記數器開始記數
總之就是能夠記數0-59, 個位數記數0-9, 十位數記數0-5
' }9 E4 v8 R+ y) u' e+ _% a. Z- v
請問各位有人有設計過這樣的電路嗎? 或是要去哪裡找相關的資料勒?
1 H  l1 f3 S" z) x7 M  y. ?7 z2 a謝謝!

小朱仔

原帖由 monkeybad 於 2007-8-28 10:40 AM 發表
如題
* e3 \( E0 {6 ^小弟我目前在設計一個時鐘電路 需要一個記數器 不知道這個問題是不是屬於這個討論區
如果不是麻煩版主修改一下囉

目前這個記數器要能數0-9 接著就進位 然後自己reset繼續從0開始 進位後訊號再繼續由一 ...

( |. u3 Q5 J% m; f' d" C
大大您是要寫Verilog還是電路

先PO個RTL Code參考看看

輸入：N clear load clk
輸出：count

行為描述(依照優先順序)
2 E) \4 Q, ~8 c3 F% X! c2 @8 Z  Z1.如果clear為1，則輸出設為為0
7 e4 R# G  b5 T; h/ _& y2.如果load為1，則輸出設為N
1 [4 i9 ]+ }( d0 D3.每個時脈輸出遞增一次(BCD)

& ~. N7 P0 Y* M8 A

5 z% @9 V: r! V7 L+ d  t/ U程式碼：
2 a2 B3 k7 i. C, g* H" S: C1 yBCDcounter.v

module BCDcounter(clear,load,clk,N,count);
input  clear,load,clk;
1 K4 x5 P% q0 Iinput  [3:0] N;
output [3:0] count;
: }2 k$ [8 F- r  v* }reg    [3:0] count=0;

  C2 b( p( T: M. c! n1 Lalways @ (posedge clk) begin
  if(clear)                 //clear=1
    count=0;
: M1 ^- z2 f% U  else if(!clear) begin     //clear=0(共有0 1 X Z四種狀態)
    if(load) begin
      if(N>9)
        count=0;
      else
  ?! P. t1 G, k1 \  s        count=N;
& o3 g# ?8 H9 R* Z    end
    else if(!load) begin
" j! f  m/ `" I0 L# N      count = count+1;
6 n. H( {5 E9 {- b  z& w      if(count>9)
      count=0;
( s: r9 \2 d( ]4 Z4 b7 X+ Z    end
  end
end
. H5 A. }" {- @/ lendmodule

# g: Z6 f  ]- S; v, ~& x; nbcdcounter_tb.v
5 t# S2 l& ?, ^; R
5 L; m9 c' D/ Dmodule bcdcounter_tb;
reg clear,load,clk;
reg [3:0] N;
% I# U6 D3 a7 Q8 y8 Z( Gwire [3:0] count;
( \0 Y5 c0 D: A8 q5 `( Q
- p; J0 q$ u- |% x6 jBCDcounter m1(clear,load,clk,N,count);

8 S" F- z: F8 q4 \0 W) ?& c) Oinitial
( u# J- v' K! [% @clk=0;
+ z, |, S  Y0 P6 W% ~0 y! X
7 O" A8 N5 D$ u. n% w: xalways #2 clk=~clk;
/ Z& w3 V+ a  y" I
initial
#160 $finish;
* r( I# k8 u+ z1 X6 s
initial begin
    clear=1;
& \' K0 n7 _, J5 b, r#4  clear=0;
$ y) R. z" l4 W4 X; J#90 clear=1;
#3  clear=0;
end

0 s) p6 \) S* |# A6 w. Cinitial begin
     N=6;load=0;
3 V( G: S7 V9 S8 N2 Z1 ?, h#58  load=1;
, I% A5 Z3 v7 `4 Y#2   load=0;
. g4 L+ M  r* v3 }5 M" i6 l3 s5 V#22  N=12;
#40  load=1;
$ p5 ]1 c/ E& U, o#2   load=0;
end

) I$ D/ P2 i+ ]2 Gendmodule

小朱仔

還有一份講義可以參考看看
希望對大大有所幫助
# q5 F5 l8 e" |2 K1 v5 ?( |+ ^


5 Z. l6 k: L7 x! r# n

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monkeybad

感謝小朱仔的熱心回覆
! F5 e( |. \( j* a不過我電路要自己畫 還有我不會用Verilog耶
" k; T8 d3 o- |. t- O; O# C7 j現在主要是要有電路圖 可以用Hspice模擬的那種
8 l! v5 }, `) U2 B2 `# g! \4 z另外希望inverter越少越好 因為要求要省電! 還有要自己layout!

9 Y4 x* W' @4 }樓上那份文件好像裡面有寫到 趕快研究一下! 感謝分享!
5 F( w' U$ l# _. |/ e* w
[ 本帖最後由 monkeybad 於 2007-8-28 11:23 AM 編輯 ]

tommywgt

你那個要自己動手畫CMOS電路吧...
3 B; c) K  Q6 _* h- S寫code習慣了, 真的很不想動手再做這樣的事, 不過推完booling equation後, 直接用Cmos畫出來不就好了???
; G' f8 @! M: r$ B+ E6 K沒錯吧

monkeybad

恩恩 不過booling eq好像是在推導一些輸入輸出的條件
2 A, f+ U2 Y; i8 J# F
+ ]2 i% o* f7 o' [記數器參考一些資料後 找到一個用ripple counter下去修改的
1 m! b/ v+ B( g: V* l# h% R$ qripple counter就是用負緣觸發的T型正反器串接在一起
; e* k, y7 }/ m6 x, Y( T接著開始從0數到9 然後數到10的時候
就reset重新從0在開始數

tommywgt

ripper counter真不是個好主意, 不過要看應用, 在有些地方用時倒是好東東...

jordanplus

我很好奇某大大說的講義
給我看看寫什麼吧

nic740917

我這裡有時鐘的電路圖..以送去CIC下線..可提供給大大參考看看!

mungoo

我看一看那個問題，要我聯想到CODE，一時還想不起來，真是太久沒有寫程式哩！
看到CODE，有一點恍然大悟的感覺，又接著看，害我也想看那份相關資料囉！！

liboy1122

BCD conuter 應該是對自己有所幫助

stevenert

bcd counter對初學者的我而言真的好難
& ~& H8 {. o0 T( E謝謝小朱仔提供的code囉

tommywgt

大大別忘了給小朱仔 "感謝"
' u  w0 }! o0 ?# B9 U: g4 `
按評分, 就可以給感謝了....

kevin

Let see the shared material. THX.

josephgg

幕讲义之名而来,呵呵勿见怪啦.                                             
3 ?2 {8 J% b' z) X8 f! S. C' n感谢

ycs1977

感謝各位大大的資料 對初學者 真是受益良多

mengchung68

感謝大大的分享∼∼∼∼
' c) b3 y0 w) @, h5 }8 M3 @因為你的無私，讓大家能學到許多知識

gto10620

我也想看看大大分享的講義~~
回覆來看看囉!!感謝蛤!!
% l! F1 u& N1 j& |$ \. K" v因為我是初學而已!!

gto10620

你是要畫電路圖的方式設計~
0 B+ t6 N/ y3 m3 l1 S7 Y  v/ v那畫畫卡諾圖不就好了.... 只是比寫CODE還要麻煩....
因為要接邏輯閘!!
用卡諾圖化簡!!

rick80418

最近剛接觸這方面的東西

剛好需要這些資料

感謝分享!!!