智原UR-IP Center正式營運，納入高競爭力IP，逐步實現完整佈局

jiming

詠發、晶瀚、繪展等核心會員加入，攜手為 SoC 技術與市場提前佈局
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1 l+ G* g" d2 @" T5 b【新竹 台灣】2007 年 7 月10日
1 m1 Z% l* Q# O& ]ASIC 設計服務暨 IP 研發銷售領導廠商－智原科技（ TAIEX ： 3035 ），宣布成立 UR-IP Center(Your IP Center) ，同時宣佈有三家 IC 設計公司加入成為核心會員，包括詠發科技、晶瀚科技以及繪展科技等，提供數位電視 Demodulator 、先進製程類比 IP 、 HDMI 高速傳輸介面、2D/3D 繪圖加速器等高附加價值的 IP 。智原統籌的 UR-IP Center ，成立目的是統籌整合國內具競爭力 IC 設計公司的高競爭力 IP ，同時透過智原經年搭建的專業行銷管道，積極推廣這些 IP 給海內外大型 Fabless 以及 IDM 大廠等。 一方面擴展了成員公司的銷售通路，另一方面也擴大了既有的 IP 資料庫進而增加潛在的大型設計專案。而透過這樣的合作，將能發揮資源共享的綜效，擴大 IP 業務，同時加深在 IC 設計產業裡的影響力 !

這項 UR-IP Center 的計畫由來，主要是智原在多年服務客戶的經驗中發現，客戶為了尋找適用且具競爭力的 IP 方案，往往耗費多時；而選定 IP 之後進行設計整合，又遇到相容性的技術問題等。因此，藉由推動 UR-IP Center 計畫，希望結合國內 IC 設計公司所開發出來的最佳 IP ， 來強化 IP 供應環境，以利於客戶採用於開發新產品。
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3 l+ h  G+ J4 \7 T/ Y針對 UR-IP Center 在矽智財佈局方面的規劃，智原表示將以擴充製程相關的標準介面 IP 為優先，而 IC 設計所需用到的時脈與資料轉換等類比與混訊 IP 也是佈局重點。 除此之外，有鑒於資料壓縮與硬體加速器等數位 IP 在 SoC 整合所扮演的角色日益加重，UR-IP Center 也將陸續引入性能卓越的 IP ，以提供最完整的 IP 供應環境。而在運算核心部份，UR-IP Center 將結合製程提供易於使用的高速 HardCore IP，這將大幅減少客戶過去投注在提升 CPU 性能上所需耗費的時間，同時提供更多更符合需求的 CPU HardCore IP，將更進一步提昇客戶的競爭力!
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智原科技 IP 業務暨研發副總王心石表示，「一個完整、及時且專業的 IP 支援環境，在 90 奈米以下的競爭中將更顯關鍵。過去業界缺乏 IP 資源整合的機制，而現在藉由 UR-IP Center 的推動，將使資源的利用與開發案的進行更有效率。我們也預期這個計畫的推動， 將能提供參與成員間除了 IP 以外更大的邊際效益，而這也正是我們不斷努力的目標。 」
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詠發科技總經理陸忠立博士表示 ，「我們與智原早在一些行動電視相關解決方案上有合作案，所以對於智原的 IP 技術和服務都給予高度評價 ! 奠基於這樣的實力，我們對於 UR-IP Center 自然也是抱持高度的信心，希望可以更有利於我們的市場推廣以及技術發展。 」

目前在 HDTV 數位電視相關晶片市場已經開拓有成的的晶瀚科技總經理劉鴻志博士表示 ，「對於晶瀚而言，我們在 Analog IP 方面的專業技術已獲市場肯定 。我們希望透過加入 UR-IP Center ，來進一步擴展銷售管道，讓更多客戶採用我們所推出的 HDMI 等介面 IP ，提高互通性，預期在更多客戶採用後，晶瀚的數位電視介面 IP 將成為數位電視業界互通測試的首選標準 ! 」

以手持行動多媒體 2D 、3D 繪圖晶片為研發主力的繪展科技總經理黃勃為表示 ，「 手持行動多媒體晶片的競爭激烈，整合度也越來越高，繪展除本身擁有專精的 2D、3D 繪圖加速器技術外，為著眼於未來的 SoC 佈局，目前已積極佈局未來高整合度的 IP 需求。過去和智原科技在 IP 上已有合作經驗，未來藉著加入 UR-IP Center ，也希望能利用此一更完善的 IP 供應環境，以加速我們的SoC 開發! 」

除了佈局完整的 IP 供應環境，UR-IP Center 未來也將進一步積極地協助其成員與客戶在大型專案上的合作。 提供產業分工所需的共同平台，讓擁有專業技術的中小型 IC 或 IP 設計公司能藉由開發 IP ，有機會共同參與大型計畫的開發。 這對於半導體產業的健康發展，也將有極為正面的意義!
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欲了解更多關於智原科技 UR-IP Center 的資訊，請參訪智原科技網頁http://www.faraday-tech.com/ 或E-mail至 IPSales@faraday-tech.com
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關於詠發科技
& I% k! L! `5 U& P! L* {詠發科技股份有限公司為 2002 年 10 月登記設立之專業 IC 設計公司，主要業務為通訊及網路 IC 研究、開發、製造、銷售以及相關技術服務。詠發科技之經營及研發團隊係由矽谷及台灣資深主管及工程師組成，包括曾任職於國際知名高科技公司、從事通訊網路 IC 和 IP 研發及產銷之高階人才，具豐富產品開發經驗。詠發創立時即確立以通訊網路 IC 為研發方向，以期成為台灣 OEM 及 ODM 客戶主要技術夥伴及 IC 供應公司，並持續以領先的 SoC 、 DSP 和 Analog Circuit 技術及先進製程，推出高速、高整合度的產品，應用於 Home 、 SOHO 以及消費性市場。   
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* G  D$ K$ m$ y# ]9 y* N) ]關於晶瀚科技
晶瀚科技 (CAT) 成立於 2003 年 11 月，以提升數位家庭產品之發展及電源管理相關產業為導向，聚集了數個國內外多年研發經驗之技術團隊且持續擴充中，主要從事於高階類比 /DSP/ 混合訊號等及各 3C 領域之晶片研發；期許晶瀚科技成為世界一流的類比與混合訊號 IC 設計公司。晶瀚科技擁有堅強的經營與研發團隊，以領先的技術，不斷地開發各項新產品，提供完整的電源管理解決方案及各 3C 領域的 IC 設計。晶瀚科技秉持著：創新 (Innovation) 、技術 (Technology) 、服務 (Service) 、品質 (Quality) 之經營理念，提供客戶完整的電源管理及各 3C 領域的解決方案，以降低成本，提升競爭力。  
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關於繪展科技
繪展科技（ SMEDIA TECHNOLOGY CORP. ）是亞洲第一家擁有完整低耗電的圖形、視訊、影像等多媒體技術的 IC 設計公司，並於 2004 年底，推出全球第一顆高度整合視覺方案的晶片。繪展科技成立於 2004 年九月，整個團隊乃完整來自於矽統科技（ SiS ）旗下之多媒體產品部門，致力於開發手持式設備的多媒體協處理器（ Mobile Multimedia coProcessor ），主要股東為聯華電子（ UMC ）。目前已開發完成包括手機專用的 3D/2D 圖形加速 (OpenGL_ES, Microsoft D3DM, J 2M E 2D) ，影像處理 (AE/AWB/AF of CCD/CMOS sensor) 、視訊壓縮 (H.263/H.264/MPEG4) 及音訊技術 (MP3/AAC/ AAC+/AMR...) ，是台灣唯一一家能 100% IP 技術自主的團隊。  
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! T. d5 g9 z0 p1 ~; i! I8 b& z關於智原科技
智原科技（ Faraday Technology Corporation ） 是亞洲最大的 IC 設計服務公司，全球員工超過 700 人， 2006 年營業額為新台幣 55 億元。智原科技總公司位於新竹科學園區，並於美國、日本、歐洲與中國大陸設有研發、行銷據點。智原科技主要提供矽智財元件 (Silicon IP) 、客戶訂製特殊應用積體電路（ ASIC) 及 ASIC 設計方案等服務項目。重要的 IP 產品包括： 32-bit RISC CPU 、 DSP 、 MPEG-4 、 H.264 、 USB 2.0 PHY/Controller 、 USB OTG 、 Serial ATA 、 10/100/1000 Ethernet MAC 、 10/100 fast Ethernet PHYs 、 PCI Express 、 Cell Library 、 Memory Compiler 等數百個週邊數位及混合訊號 IP 。關於智原提供之設計方案與矽智財 IP 產品，請參閱智原科技網站 : www.faraday-tech.com。

masonchung

到底IP是IC設計服務公司提供給IC設計公司 還是由IC設計公司提供給IC設計服務公司??
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( D; x3 o, \! ]0 P' M這就好像山雞養殖場到菜市場買雞蛋一樣的令人不解

$ R3 V; _* B) s# K1 @9 s3 f雖然說IP就像養雞場的雞蛋一樣,但是到菜市場買的雞蛋真的孵的出來嗎？
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  z! W. ?  ]0 _菜市場賣雞的攤子哪會在意籠子內雞蛋的品質好壞阿∼
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真正賺錢的是籠子內的雞阿∼
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也就是說,會動的ＩＣ才能賣好價錢阿∼∼
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% }7 x0 k, X  z, T, m[ 本帖最後由 masonchung 於 2007-7-27 07:35 PM 編輯 ]

chip123

masonchung 大比喻的妙！只是市場走勢，怕是IC設計服務公司與IC設計公司都分得不是那麼清楚了？
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-持續優化設計流程、測試品質及可靠度，協助客戶降低成本與加速進入市場-
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" w1 q% k5 u2 ]: B* t0 W【台灣 新竹, 加州 桑尼維爾】2008年3月18日
ASIC 設計服務暨 IP 研發銷售領導廠商 ─智原科技 (Faraday Technology, TAIEX: 3035)今天宣佈將開始提供SiP (system in Package)設計服務，目前已開發RF SiP專案，主要應用於GPS產品。智原並將持續優化其設計流程，包括設計流程自動化以及提供客戶封裝及電性分析報告等。SiP的優勢主要在於產品體積可大幅縮小，開發時程縮短，電氣特性與效能亦可得到大幅改善；同時不同製程之IC、被動元件等可透過系統重新整合而封裝在一個SiP元件內。

9 i- I3 \6 F: K# y智原所提供的SiP設計服務，是從客戶的需求出發，以提供優質且值得信賴的服務，首先是針對SiP封裝可行性分析，智原發展出快速及最佳化解決方案，另外也能協助確認客戶所提供的測試樣本 (test patterns) 品質是否合乎需求。此外智原將依客戶量測目標，與客戶合作開發專用測試模組以增加SiP內各零組件的測試項目範圍，期望可以達到低DPPM (Defect Parts Per Million；每百萬分之一的不良產品數) 的目標，提昇測試品質及可靠度。
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智原科技IP業務暨亞洲ASIC業務副總王心石表示：「與SoC相比，SiP可快速反應市場不同之需求，將所需之功能以裸晶(die) SiP封裝整合，SiP不但可以彌補SoC設計和生產之限制，更可進一步擴展客戶既有ASIC產品的功能。 由於一個SiP案所涵括的各種專業領域較一般晶片設計更廣，設計過程與產品測試所需考量的項目，也成為一個SiP開發案成功的關鍵部份。客戶藉由智原豐富經驗的協助，可以快速的讓產品上市，同時提高其產品的競爭力。」
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% H9 J+ j* b3 X# F智原為客戶建立的測試模組，目前已獲得數家主要客戶導入，透過整合客戶端提供智原所定義的各項資料，均能夠得到客戶端全力配合以共同提昇測試品質與可靠度，針測(CP)部分可以更接近封裝後(FT)的測試結果，拉近結果產出的誤差，目前已完成的SiP研發案，其測試穩定度及品質均能獲得客戶的肯定，智原並將以持續提昇客戶滿意度作為下一階段的目標。

heavy91

領先同業通過認證，智原推出90奈米高速PCIe 2.0
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- \8 z& I* }8 lASIC 設計服務暨 IP 研發銷售領導廠商 ─智原科技 (Faraday Technology, TAIEX: 3035)於今日宣布，其以PCI Express 2.0規格為基礎研發出的PCIe GenII PHY，於近期通過了PCI-SIG® APAC認證測試(compliance test)，成為台灣首家可以提供PCIe GenII PHY的廠商。智原的GenII PHY不但能向下與2.5Gbps的GenI相容，同時在jitter、誤差幅度(margin)及接收靈敏度(sensitivity receiving)上更提供了較佳的效能。智原科技PCIe GenII PHY為UMC 90nm製程，已可提供ASIC客戶進行晶片設計。

1 m% B' Z4 `: j# y; U! ], y0 cPCIe 2.0的速度為PCIe 1.0的兩倍，每線道(lane)從2.5Gbps增加至5Gbps，能為亟需速度的各種應用滿足其與日俱增的需求，如：儲存、圖形顯示、高速網路連線、以及晶片與晶片間的資料傳遞等。而隨著PCIe GII的推出，智原科技一則可以協助客戶進入更多新興市場，另一方面也可以藉此提升他們目前現有產品線的效能。除此之外，運用智原科技廣大的IP資料庫與卓越的ASIC設計能力，客戶更可以一次購足所需，降低他們在IC整合上，可能面臨的高度風險與時間/研發成本。

  {) @9 R) @  [/ O  \智原科技策略長王國雍表示，「承襲著我們過往在高速輸出入介面的豐富經驗，智原不論在技術研發或是市場拓展上，都較同業來的領先並具競爭力。所以在這次PCIe GII PHY的開發上，我們也得以率先通過認證，成為台灣首家通過PCI-SIG® APAC認證測試的廠商。而在市場的開發上，目前我們已接獲數筆包括express卡與橋接應用產品的design win，且還有許多新興應用領域的案件正在洽談當中。」
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智原科技自開發PCIe1.0以來，相關的研發團隊包括在系統測試以及客戶的合作方面，都日積月累了許多重要並關鍵的核心技術與能力，例如其中用以補償insertion loss的equalizer技術，不但墊高了競爭者的技術進入門檻，也成為加速智原開發下一代PCIE的動能。

智原科技營運長臧維新表示，「我們非常高興能夠領先同業在first-cut work就通過PCI-SIG® APAC 相容性測試，同時所開發出來的GII PHY尺寸又具備高度競爭力。這樣的成就不僅是對研發團隊的肯定，也代表智原科技已具備開發下一代更高速SerDes的設計能力，我們相當有信心能夠邁向下一個重要的里程碑。」

供貨時程
通過驗證可對外供應的產品線包含：

• PCIe1.0 PHY: 0.18um及0.13um製程
• PCIe2.0 PHY: 90nm製程
• PCIe2.0 end point controlle

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[ 本帖最後由 heavy91 於 2009-4-30 09:41 AM 編輯 ]