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[問題求助] 如何用H-Spice模擬FR-4板的傳輸線

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發表於 2007-6-13 14:21:40 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
3Chipcoin
有聽過人家用SPICE模擬PCB板的傳輸線,所以上來請教大家,9 n( v# q, }/ U8 G6 ]0 T
請問各位先進有人用SPICE模擬過FR-4板的傳輸線嗎?
, o0 \1 o1 f  g: C4 u6 G該怎樣模擬,還有語法如何去寫?
, I: F: a- q8 T. c& Q如何做傳輸線的考量?9 }# B0 n; q) j# W
如果我要做2MHz的資料傳輸和接收,除了用Pre-Amplifer以外,還要考量哪些東西,
8 @, `0 G: E3 s: Q% T' H1 }2 a( x才讓接收的資料正確。
% Y) e6 \( s8 [目前預計使用FR-4板,傳輸線長50cm,寬0.5cm。( t- y1 T4 T! @3 l) J. O8 B
麻煩大家告訴我該怎麼做,非常謝謝你們。2 F" T7 G% Z8 q4 R$ v) m% v
, I- L3 e7 E2 A2 K. o! N! A2 U, S
[ 本帖最後由 jelly811737 於 2007-6-13 02:34 PM 編輯 ]

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我沒有做過FR-4傳輸線的模擬 不過,我們有做過SATA,它是一種高速傳輸的方式,也許可以給你一些參考 首先,有關於傳輸線model的取得 當初我們是請工研院幫忙將傳輸線藉由工研院的儀器來萃取R,L,C model 因為每一家廠商的傳輸線的model均不相同,而且,SATA是一種高速傳輸的方式,其R,L,C model會影響其performance,那時只知道工研院有儀器可解出傳輸線的R,L,C model 而FR-4板子的傳輸線算是很常用的傳輸線,也許一般的廠商也會提供FR-4板 ...
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2#
 樓主| 發表於 2007-6-15 11:49:01 | 只看該作者

回復 #2 finster 的帖子

最近聽說同學說ADS裡面有可以模擬傳輸線的,
) \, c& u4 A/ Q, Q而且有FR4規格可以模擬,裡面好像就有廠商內建參數可以模擬出RLC值。/ S. P2 W0 n( `; J+ [3 D
不知道這個模擬出來是否正確?或是用HFSS好像也可以模擬,! Z" }/ _' z# W6 w9 P- ?% x
這麼多模擬軟體該選哪個好?
1 V* a, c7 \$ }6 h5 c# B謝謝你的回答。
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1#
發表於 2007-6-13 14:21:41 | 只看該作者
我沒有做過FR-4傳輸線的模擬* T4 `4 L4 i! m5 u3 O# q, q) M
不過,我們有做過SATA,它是一種高速傳輸的方式,也許可以給你一些參考# j7 l! q1 N- e3 J

+ Q" O$ H& O; g" l& Y首先,有關於傳輸線model的取得
4 @/ R2 |4 u  s4 C# W當初我們是請工研院幫忙將傳輸線藉由工研院的儀器來萃取R,L,C model
. D0 k! A$ G6 t% z8 K因為每一家廠商的傳輸線的model均不相同,而且,SATA是一種高速傳輸的方式,其R,L,C model會影響其performance,那時只知道工研院有儀器可解出傳輸線的R,L,C model
) I( l* L  {! D+ m$ M1 p: E* w而FR-4板子的傳輸線算是很常用的傳輸線,也許一般的廠商也會提供FR-4板子傳輸線的R,L,C model
5 [/ X6 N* n4 L就我所知道,傳輸線的model均是由R,L,C三個參數所構成的,所以,在作SPICE模擬時,只要加入適當的參數即可
1 J# s; f; L+ ?& \  [
$ x# G% E- l' t  X/ s# v再來,傳送和接受是兩種不同的方式,一般均稱為TX和RX! F& s9 z; n# s
在TX部份,核心部份是PLL,然後才是編碼與pre-amplifier和driver,我不確定你們需不需要用到pre-emplasis,因為這個功能是為了防止信號在傳輸線衰減而作的,在高速傳輸中一定要加,但你只有2MHz,實在不知道傳輸線衰減會有多嚴重. M0 ^' [: T/ B- Z/ a- ^' I
在RX部份,核心部份是CDR(Clock Data Recovery),然後是sample & hold, synchornizer和解碼電路,其中CDR電路是最難做的部份,因為它的performance會直影響到取樣出來的data是否準確,再者,現行的CDR架構可分oversampling和tracking兩種以及利用DSP來實現的CDR,每一種均需相當精深的電路技巧
& x8 s, B0 F0 t" G
9 c& f8 ?( i& ?- l7 H最後,TX和RX端的電路是一個非常龐大的系統,當初我們共有五個人來設計整個TX和RX相關的電路,大概花了快半年的時間才完成初步架構0 l) }1 u( q5 B5 u: f; m, n8 K3 F
這並不是個很簡單的電路5 |9 w' N# x: E* Q
除非你己經有現成的TX與RX的相關電路或者IP
& W) t6 t/ @, ~, ~若要自己開發,那會是一件很艱難的工作

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