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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積+ ^* O$ U0 Z( ^3 A6 M0 N
2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流
: k8 H' @  L2 d0 h' Z, S3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
3 H6 T9 m  e+ J; e! `你勉強把東西 塞進去之後  好不容易做完- |" V! Z7 e/ e' S' K  V& f& P
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
  S/ B  T: X' G' ~0 h) P% a一直改圖對LAYOUT來說是最花時間的# e* k8 S. L6 o" Y
或者是 沒有看清楚 RD寫的NOTE( |, f* h# B0 P2 H5 e3 G+ V/ K0 M
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的* [6 n5 G1 E9 l! T) ?3 A

4 O2 H3 R- {3 i有時候我們公司RD也不想讓LAYOUT一直改( {( j$ b, |4 U! \3 S
只是因為有時專案太趕
% g' s6 q; [9 T所以只好跟LAYOUT同時平行做
; W4 L0 ~3 g  g. r" V6 n+ m這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~$ u) L+ d) P) t5 L# _
光是排列就會影響後續走線3 @; N. c9 f1 z7 o% ^& {
所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
7 f! j  _% u7 Q! ]3 t0 o: A7 Z最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖
/ u$ S2 [: Z, ?: x, m' a然後整個的大小不變，但是改的地方，又比原來的大一些4 O! S! |' H  o0 f) E
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非! ~0 }% [9 e+ b! C7 u, [

( o3 U' l! b3 {我花最多時間的是在思考，
- l! H1 X% R9 n6 k一個5天該完成的案子，我可能會花去2~3天思考。1 z3 q) \2 W8 V. d/ K% ]- Q* s0 k
事前想的仔細，# o, W$ z0 C! I% u: b. |
開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！; H6 F- I+ Y/ E- N3 f
整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順: C% I' U5 I. ?6 Z+ T6 }; p* E
我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎! V8 i4 k  n$ I3 D5 K+ B
LAYOUT我覺得每項都很花時間' y/ c' n, J' c
不管是佈局還是LVS/DRC5 t+ m; _5 S$ a8 B, @5 }
每項都得小心翼翼
6 \# K: o3 L' e! r  K做快不見得好1 w6 d* w( e7 x- F3 ?3 x$ X" f
做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~; Q$ w$ s9 n+ F; A/ x* T9 p  X4 p
因要如何將每個block充分擺到適當的位子~: ]  D0 z# m4 ~6 l; H$ c
這是一種學問~
/ m. o0 c& m8 X+ T4 r因擺的好的話~
2 K+ l% r5 Q) ^* G* p) C4 V其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
3 y) w, i1 h" l6.  整合 Chip Integration# A/ B6 S" h$ ^& v
7.  溝通 communication
6 U7 k8 i7 A: @! h5 M這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧0 W# J/ ^$ c2 }; H# o& v
' z( {9 {' o$ L! X
在layout初期就要花很多時間先想好如何排列
# \7 J5 F% [. a1 T" o
! M! w' |. e1 b9 H; {想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...2 a2 ^* q( {! B) [7 |; _  D, p; a
要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
" T. y; F' e4 n3 O8 F' z& X" F/ f4 |% v6 K2 D5 j, L
其他就會很快   相對LVS 問題也比較好除錯( ]6 L  \( o& U0 L  f5 ^, l+ W) v( ?
2 a& M$ e0 u$ J7 c9 b9 p
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
+ Y5 e+ i: E6 S, S2 ?再整合時也會是另一個問題
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