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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積
% G$ z5 j, [; c. `: f2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流( T0 x% x- |* N7 {
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠, J5 Q8 {& L1 A( v& q! I
你勉強把東西 塞進去之後  好不容易做完( ^9 o# l; `! g
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說! ~) c5 i6 x  Q3 t" m! g/ v9 m
一直改圖對LAYOUT來說是最花時間的- F5 i  x% M# s, K8 h, p% f
或者是 沒有看清楚 RD寫的NOTE) O& I: r' ^& r/ ~! L- _
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的
4 @! _# B* _5 `7 q: d
1 {8 y4 ^2 [; F5 g# R有時候我們公司RD也不想讓LAYOUT一直改
# A* T3 E3 w5 [9 f3 L只是因為有時專案太趕
, M, }% [8 V8 j" b/ K; ?所以只好跟LAYOUT同時平行做. l& l5 e, t' A0 v7 W( r4 ?1 J
這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~1 h& J3 c( I6 o  A
光是排列就會影響後續走線
7 _0 c+ c& N$ F$ f所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
/ m1 {9 F% B6 O1 y) _8 u  J最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖2 [6 j7 |1 a( o. L+ c8 P
然後整個的大小不變，但是改的地方，又比原來的大一些3 L4 L: N/ {( P- W
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
! x4 j- ~" Q3 D
  a8 c+ Z2 a! E: W( ?& `% p我花最多時間的是在思考，1 t6 Z4 e# M3 B6 B; F. p
一個5天該完成的案子，我可能會花去2~3天思考。& H5 `, U  U7 m6 W$ \
事前想的仔細，& x; t8 z* R! O& h" n0 U8 P6 {
開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！
- T/ o: R3 R, w; |, O- Q9 ~) }9 [  c整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順8 g) R3 _7 Y: S( l; A5 c
我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎+ I2 `' Z, U. H& ~, f
LAYOUT我覺得每項都很花時間
4 f* x! Y0 P+ g8 h- ^不管是佈局還是LVS/DRC& m! ]3 `1 R' }+ c  M3 g
每項都得小心翼翼5 X2 t; S& M6 k4 ~, K
做快不見得好
7 G! Q: l0 s  M, J- W* P. Y. h做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~3 I& p0 `, [& P9 d/ n
因要如何將每個block充分擺到適當的位子~
3 ~; }; g6 n3 R* m這是一種學問~
& q; R9 d; F" l因擺的好的話~+ Z9 v# n# |  m& y9 W: [: z
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
$ E2 x  |) E* K# y6.  整合 Chip Integration3 u, J* s. J  c; n: f% Z8 o
7.  溝通 communication2 |8 a$ }! v7 {
這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧5 J1 w) z9 `8 B5 ^! `" w6 W
7 s$ D- H+ D+ P+ f, O6 h" G2 O
在layout初期就要花很多時間先想好如何排列
; I, I+ w: F3 d% ]; P3 `
: T% C6 V1 a# R6 {7 e0 @想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
' P$ @( V3 u3 X要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
" t- M5 R% N2 o3 ^2 @3 u& k' r, O' B4 j- U
其他就會很快   相對LVS 問題也比較好除錯
. I2 b+ J+ f% Q3 T% S% }0 M: J" h% ?7 p! z
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
9 O4 j- o4 d4 D7 G再整合時也會是另一個問題
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