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If CLK present when writing a Counter latch or ReadBack Command,
2 E! X0 w x' |/ ~, V; ~7 z) _7 wat TCL min CLK will be reflected in count value latched ==> TCL 為負值 ,counter 正要開始變化, Latch值為舊值+ e: {" V0 P- _- o- D
at TCL maxCLK will not reflected in count value lached.==> TCL 為正值 ,counter 正在變化中, Latch值不確定( G% G; d2 p' a
0 T) G) S8 ^. F' D/ F) ~∼這樣應該很清楚了
+ K4 t6 }) X1 Q c" d$ z: G/ j2 O. x" [1 ? E5 w* F: Y1 _; G6 s4 r
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