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樓主: kolong
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[問題求助] PLL 的實現方法?

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1#
發表於 2007-6-8 19:19:44 | 顯示全部樓層
問一下下...( x" Y7 V. u2 I. b
, w7 W$ T  t9 e/ b; S5 N# M. s
你有HSYNC可用嗎? MODE 有固定嗎 ?: G$ B( f3 n: O! {$ x4 X, q! i8 q7 t
有的話至少已經上 KHz& r3 G$ h' q. m/ f# M% c
而且就倍數來說一定也會跟VSYNC同步吧
2#
發表於 2007-6-10 21:50:08 | 顯示全部樓層
... 這樣說吧) P1 {1 F5 y  c0 {
如果有 PIXEL CLK 就用它除頻8 s+ L3 i& S) M0 U  z, U9 s
如果有 HSYNC 就用它倍個幾次$ N! j7 ]; t: h* M$ L

! o6 S2 j& @/ V: a  F+ I: [因為 PIXEL(DOT), HSYNC, VSYNC 之間有一定的倍數關係
- k/ u( P* V0 ~" ^: m8 d4 X- R
: m, |! U6 P  |! y/ X   640x480@60Hz => 25.175MHz (39.7ns). q0 y! K# n. j7 a" E
   DOTx800=HSYNC, 39.7ns x 800 = 31.469us6 t$ H' @. L* t
   HSYNCx525=VSYNC, 31.469us x 525 = 16.52ms (60Hz)( A( U: e' a1 E6 L; c
所以這樣的CLK一定會和VSYNC同步 (詳見VESA Monitor Timing SPEC)
3 }1 p$ {7 d' c6 C2 Q
, q8 f1 O4 M) r接下來如果要VSYNC時不出CLK.. 那就用個AND閘吧 (看你用哪個MODE, SYNC有High或Low)
8 u2 _0 Y; a7 K6 n) \) j4 p1 i$ @) w! D  x7 e7 L& f4 N) T/ X  [
還是我想的清況和你不同呢?
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