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[問題求助] full-custom 流程 是啥?

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1#
發表於 2008-9-4 23:55:21 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
請問一下 在verilog� full-custom 流程是指啥
6 m6 u4 |2 I' X. E3 x我之前只有參加過full-custom的IC佈局4 S. s: ~6 h: k; R1 H
只知道它是給你題目要你從頭做出他要的頻率的電路而已 (感覺就只是很單純的出題)0 w9 h" }4 t5 I
可是我們學長 給我一個題目是用full-custom流程設計ALU
0 y) P6 ^8 F9 w但是ALU不就只是寫出一個選擇運算模式的計算機
5 Y$ i9 W* X4 S' _- b  q" r只要利用選擇的指令 寫出A和B兩者或單獨位移等等的運算嗎?
: Z5 Y9 F4 I' V0 ~" v) J實在是不明白full-custom  是用在哪裡- u& p% ]; s" O7 H6 \6 \6 j
之前也有去教育局的full-custom裡看考題 也看不太出啥差異的說  =  =
* L; s) z! U7 {; _- m6 E  a& X麻煩好心人士 能夠幫忙解謎  謝謝   >"<
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9#
發表於 2022-1-14 10:50:10 | 只看該作者
太好了 剛好也有這樣需求 謝謝分享喔
8#
發表於 2021-7-30 08:21:08 | 只看該作者
一般來說
, r9 M+ `" A9 e# ~, M( @  L4 Mverilog流程會稱為cell based流程(數位流程)" c  \  z" f2 E" s2 i
full custom流程會稱為類比流程
& T8 R9 i! K( y6 z1 t' }: G因為類比每個元件尺寸都需要嚴格設置
7#
發表於 2015-8-22 11:23:21 | 只看該作者
受教了....感謝感謝了Full-custom IC design style 全客製化設計! f) s8 u3 i0 c! |! |
9 \! B  ]$ W' J+ @4 y4 P' J- \消耗大量人力資源成本來進行佈線# I( E8 ~% D% b! a# \+ ]: f
簡單的比較6 V! U
6#
發表於 2015-7-1 17:40:28 | 只看該作者
去CIC的網站看吧!!9 ]- j% m7 b1 @
上面有很多資訊!!
5#
發表於 2014-11-18 17:24:45 | 只看該作者
Full-custom IC design style 全客製化設計. y) L( L6 A3 q5 k1 _7 j
消耗大量人力資源成本來進行佈線0 J2 u( ^. M/ g
簡單的比較) Q- o* ~: Q, ^& Y; L- @. @/ \
                                     Full-custom           Cell-based- ^) G' Q' a: H9 U; z4 _
Automation                        poor                     good9 I0 C. x8 M1 R9 p! Q" d' A0 o
Flexibility                          good                     poor; e9 ]; S' s! F2 u% M( [* g
Scalability                          poor                     good+ ?) F4 m& `: u5 o, H) s
Area utilization           can be optimized         poor
% q3 r  ?- R$ j& @* ]  _9 B5 TWoking period                   long                     short
! Y- ]) H% d& c* S3 S0 a" z. Xnumber of transistors         small                    large
& Q) `( q  g2 V2 Y' C3 g) E5 L* \來源:tw.knowledge.yahoo.com/question/question?qid=1608042312284
4#
發表於 2012-10-1 16:45:01 | 只看該作者
受教了....感謝感謝了
3#
發表於 2008-10-31 13:22:15 | 只看該作者

早期的IC設計

早期的IC設計都是full-custom! x6 [* O+ V" C9 u- @) Q8 H2 ~
都是從gate-level甚至mos-level開始電路圖; |6 J6 y' y& @
然後layout也是人工畫cell拉線
( M' _: d' \% Y5 w8 k4 x你知道更早期layout是先畫在紙上的
2#
發表於 2008-10-21 10:06:47 | 只看該作者
以 foundry 所提供的基本元件,如電晶體、二極體、電阻及電容等元件作為設計的基本單位。3 Z7 e; a, a, M
一般來說是採用人工的方式擺置元件及佈線,所以可以得到最佳化的面積採用率及較佳的電性。+ H/ b  }% |( L5 t$ t* R' A
講求高精度的類比電路往往是以全客製化的方式來達成。
& Y% u& f# s" `7 H8 _
- W& W+ o: J% V( B6 o- ehttp://www.ntut.edu.tw/~vlsi/86-vlsi/AppendixA/AppA1/AppA1.htm1 W8 [' J+ K7 E* A3 }7 d% W# E
4 t) n6 S) d# `( o) t  u* J$ b7 K9 h
希望這個網站可以幫到你
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