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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › verilog的基本介紹
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verilog的基本介紹

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hiyato
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1#
發表於 2008-4-11 21:12:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
, {) i: e6 q7 }# h( M% N

3 y' Y% @) q  Y$ A, L檔案名稱：verilog
( Q& n' u# H* \8 t; k- i/ V. ?" S0 s檔案大小：658K
; Q8 F4 f. L8 [檔案內容：中文* A5 W3 b5 j/ O5 `
檔案簡介：verilog的基本介紹，對於新上手的學習者，建立基本觀念

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2#
發表於 2008-4-13 00:35:12 | 只看該作者
小弟我想看看Verilog HDL和VHDL有何差別，還是一樣的東西??0 e3 \6 i7 Z6 F
, B" u8 ^3 y) |! ?* b3 Y- K- m
謝謝hiyato熱心的分享!!
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rsun49
3#
發表於 2008-4-15 23:51:56 | 只看該作者
thank for ur doc..........................................................
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ricky000
4#
發表於 2008-4-27 03:44:15 | 只看該作者
謝謝熱心的分享!!5 C; g2 `  B; N1 ^
謝謝熱心的分享!!9 i- Q5 N& V& }9 x3 y6 ]2 N
謝謝熱心的分享!!
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u9011311
5#
發表於 2008-4-28 21:03:30 | 只看該作者
英雄惜英雄謝謝熱心的分享!!謝謝熱心的分享!!希望對我們這些初學者有幫助！
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tear086
6#
發表於 2008-5-11 16:45:35 | 只看該作者
谢谢楼主分享。…………………………………………………………

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sjhor -3 敷衍回覆！

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kevin
7#
發表於 2008-5-12 13:44:10 | 只看該作者
thank you for sharing this material

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參與人數 1Chipcoin -3 收起 理由
sjhor -3 敷衍回覆！

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usefun
8#
發表於 2008-5-13 14:55:17 | 只看該作者
好想看看 這個跟verilog的書有何差別 = =
, u0 P+ v& g, i% J 可是要用買的，
1 o; H8 P% w) ~0 @- z8 _) v; { 不知用怎麼用
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9#
發表於 2008-5-14 17:46:10 | 只看該作者
好東西 感謝大大的分享
) D9 P) d6 o1 N8 [9 l靠人不如靠自己
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10#
發表於 2008-5-29 20:14:04 | 只看該作者
感謝你的分享
- ]3 h  p  P/ q. a2 [% C$ C感謝你的分享( I- {4 u! u% ^+ g; V
Thank you for your share
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40506666
11#
發表於 2008-7-15 09:58:38 | 只看該作者
謝謝您的分享                                                   
# v1 S( e  I6 v( [( [8 c我正好在學習nios
% F, G: a, B" S: M6 r. U. ^謝謝您了
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eliotj
12#
發表於 2008-8-18 09:05:05 | 只看該作者
Verilog新手
# [9 N# n0 h9 Z- l. ?正\想學習verilog) v; o/ R2 z6 W4 @+ D* p/ _' u% K% n
感謝大大提供
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uncommon
13#
發表於 2008-10-10 18:15:02 | 只看該作者
基本的語法是我所需要的...
1 @$ D# y' r. D! s+ Q/ f. n
! e& f/ U: V1 p' S看書看半天都沒有頭緒...
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qazjken
14#
發表於 2009-7-23 12:02:47 | 只看該作者
感謝大哥的分享 小弟我正在學習verlog 遮將對我有很大的幫助
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15#
發表於 2009-11-1 17:09:54 | 只看該作者
真是太感謝了~~這東西對我這個初學者~一定有莫大的幫助~
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16#
發表於 2010-1-6 09:59:06 | 只看該作者
非常不錯的資料！對於剛踏入這塊領域的新手，剛接觸 Verilog的人是一個很好的教材! 感謝分享！！！
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cch39
17#
發表於 2010-2-24 17:28:33 | 只看該作者
這種對Verilog的初學者來說真的是很棒的教材, 感謝分享
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k369
18#
發表於 2010-3-3 10:22:35 | 只看該作者
That is very good verilog data. thanks.
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19#
發表於 2010-4-28 16:30:48 | 只看該作者
我也是verilog新手, 有這麼方便的東西
( @) w3 l9 z; \6 e8 {想當年數位邏輯設計的課都用麵包板都線路
) G" [. g* u0 g; `7 t9 u現在有這麼方便的東西真好
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20#
發表於 2010-9-29 01:32:23 | 只看該作者
哇哇～～正需要這個，新手中
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