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大家在這版可以如何互相成就共同邁向Layout達人之路!?

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1#
發表於 2008-4-7 12:53:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我是 Hao 前來 chip123 報到 : @* R$ e3 P* a4 n7 M' _
haosaire:想向大家說的話:希望能在這裡變成 Layout 達人. K7 j: b/ W" w( l- U! p& b
; a" G  Z$ P2 m# o2 V
大家在這版也許可以,或應該如何互相成就共同邁向 Layout 達人?9 w% g0 o" v& h2 }: l+ R& e
/ _/ _2 _& s# U7 E( O
layout中該注意的事情
+ v2 ^& Z" r# S( c# M% h8 b結訓於IC Layout課程的學員請自我檢視專業能力
/ Y  y0 N: L  w4 B2 J; I佈局工程師應該成為十項全能冠軍!?   1 2 ; J, ]" {6 Q. ?, K+ t
0 x& F9 G. }( h; M; l
[問題求助] :知識討論
* t' d- w; }7 T7 U* X[經驗交流] :知識交流
* T2 j, T1 W5 m. m. @好康相報   :知識分享& Y! ?" _1 k/ s5 n8 k+ k( t

: a; {7 D- q- z9 G底下為三家公司所徵求的Layout 達人:大家有哪些可以討論的呢?   派遣?年資?溝通?管理?
+ \7 [# f& s4 ?
. v& A; z$ n/ G& E7 I
類比IC設計主管IC Layout 經理IC Layout主管
長期派遣,直接管理人數約未定非管理職,無需負擔管理責任非管理職,無需負擔管理責任
5年以上mix-mode IC design 經驗
/ I6 P$ e$ o& Csensor or image 類比IC設計經驗者 $ x: c8 S  v" ?4 o+ P2 e
熟手機及電腦週邊產品應用
需負擔管理責任,Analog layout經驗熟悉Calibre tools1. Analog IC Layout/ O$ n7 F" T( G
2. Command file edit
; h% E" O8 Y  k- R( E9 P: e5 O3. Project Plan2 I! I5 ]- W( P4 o2 s7 r, }5 k# B
4. Latch_up預防
0 e2 d8 |' P3 p5.新製程了解
4年以上
' q$ H1 `0 Z. O+ ]Calibre & DRACULA
3年以上1. Analog Layout二年以上經驗佳# `: {% M  T  G0 C! e) d
2. 有高壓製程經驗為佳.+ I% ]* F4 u' v) R
3.了解Dracula command file 語法6 c8 S- U% D$ e4 x! q- R
4.有能力了解新製程+ `( |5 g7 k8 e
5.具良好溝通能力,具責任感
$ c( Z2 g. F6 a
# ^" `& f$ b' b
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2#
發表於 2008-4-8 09:41:43 | 只看該作者
大大你所說的IC Layout 經理這項
6 J" Z/ V- k. S+ V3 ~有打非管理職,無需負擔管理責任. P% `: M# i+ l* d0 g+ \+ A8 J" V
但是底下又寫說需負擔管理責任???/ v1 O! S1 q, z- \1 N9 ^
可否說明一下
3#
發表於 2008-4-8 10:16:28 | 只看該作者
的確奇怪!也不知道到底要不要負擔 管理責任?大概可能要吧?!
2 [8 n6 f& D- m, r8 F: ^8 z+ k4 t  c' z' C
多數的資深layout達人會希望承擔管理責任麼?還是因為卡位的關係而不得不?不過看來,業界的確很缺layout工程師? 6 ?( c% l* P' B8 v* \

# Y" X8 P& S* s( h! A3 G$ b% {2 O緯拓科技股份有限公司% X9 Z4 C/ y6 }

' O+ p! v! w0 P3 {% j6 `! {【職務說明】 需負擔管理責任,Analog layout經驗,熟悉Calibre tools。 5 }; l  `- p- V- G9 c2 u. j, ~6 v8 J) X
【職務類別】 IC佈局工程師 & R5 G/ B0 h+ v2 F
【管理責任】 非管理職,無需負擔管理責任' l. C; _8 f. F5 M, t: b2 J

- }9 R% e' C) x7 U& @( o·Manage the Physical Design team in Chengdu
) ~# l' w* P! w3 K4 l· Library Development, Layout, and Tapeout for analog and mixed-signal ICs.
2 m7 H# t9 o& v  o( A5 Q· Work with O2 world wide engineering and product teams during product development stage.
: W& y: P& t' m$ T' F" P# @! [1 _9 v8 {
需負擔管理責任,且直接管理人數約4人以下& ?' R5 A9 h% p4 }1 F
·BSEE (MSEE preferred)8 Z2 ^7 Z8 H& U  B
· 5 years experience in Analog IC Design, Physical Design, Physical Verification, and Tapeout
& _0 }. D+ e$ L  {6 i, T· 3 years experience as a Manager and Team Leader0 o+ t# k* I  L: B4 `; W, J
· Demonstrated ability managing projects with a high degree of organization and prioritization5 s3 Q: e6 U4 l6 B7 p5 T4 k/ D3 r
· Strong communication skills, high level of intelligence, self-motivation, and aggressiveness
/ E3 u- G# a& q7 R+ p: f0 t· Fluent in English and Chinese
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