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[問題求助] FPGA外接DAC電路??

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1#
發表於 2008-3-6 17:44:52 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我想請問一下~ 其實是一個dac小問題
1 C+ @# |. ~  edac輸入部分有區分成serial和parallel 那連接fpga 若我送一8 bits的訊號 速度假設是8MHz5 O7 ^6 J. e1 |8 s  o! _* `
那serial型的DAC輸出速度不就剩1MHz$ l+ `: J% }# r9 w- b% [
(我是把他想成說是一個一個bit排序接收完8個~再判讀輸出)
! _) ~; t1 v, o' O/ L$ U" i! w而parallel型輸出仍可以8MHz
' G) Z: h/ E7 G* e; _+ g我的理解對嗎??
' F" p6 P( U; ]7 S: d有人可以分享一下如何挑一顆適合的DAC嗎??感謝 * `  y) q# t- _- f  ]" m+ ~
對了~還有spec上會寫多少channel是什麼意思呢??感謝
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2#
發表於 2008-3-7 10:00:39 | 只看該作者
挑DAC?. t4 H9 H5 S/ [8 f* G) @2 o
1. 輸出的dynamic range5 ?4 Q4 m: U# V; |( u% q# [2 t# u) S
2. output resolution% }  J+ l, d! R% z
3. bandwidth5 {2 R9 \) `) L
4. 線性度  n2 n! ?% S% L" j1 E2 Z
5. power supply
8 d8 j# r) x% n1 S6. interface (serial / parallel)
3 D/ a% I& K8 Z0 g/ Q2 [以上幾項都滿足project需求的, 就挑到了
, h, w( P& q, _2 v, y+ O
: f* G0 I, n5 n3 Z1 kchannel?
% ^/ O% R  }6 U# m一個package中包含了幾棵DAC, 大概可以這樣看
8 m7 ~/ f6 |4 G  o3 E  h! `  L) v3 t. b2 A2 Z
提供一個問題, 假設DAC是 12bit, interface是8 bit, 則interface跑
- k+ Z2 |8 S5 A. L' h- f1 Mbit, 那最少要2 byte才能update DAC的輸出, 再加上一些有的沒的8 ~7 d1 \) W% i+ T* w& ~
所以頻寬部份怎樣看, 還是要仔細k datasheet才知道
3#
發表於 2008-3-11 11:51:23 | 只看該作者
基本上, serial DAC只是為了省管腳, 速度上自然不會太快! a' j3 r9 F) I& q( \
實做上, 要先訂出你要的規格再來選, 答案很快就有了.
4#
 樓主| 發表於 2008-3-29 23:54:16 | 只看該作者
版主~您所謂的定需求是指~??; F" `1 W  j: d$ S$ u: r

! H- j0 g" u+ E# Y# G6 m, t我的話就是DAC輸出能越快越好(用於光學實驗)1 h! H+ ]2 R9 {; d- r8 Z) k
=================================================% ?3 [& Z8 ]9 l7 L, H, W4 |; F
不好意思~
8 I$ u4 Q, _! p7 N& l" X9 g* c) `2 r6 k+ L6 t+ n
我想請問幾個問題
+ H6 T( R/ I  f% J+ T$ r  U- b# c7 d! P- |$ S
像Xilinx FPGA
; Q, W3 n# ]3 \0 L# F+ o% L; c( http://0rz.tw/193QX ): E  q. y1 w1 _6 B/ @
+ l5 s" p9 T) `" R
i/o有提到
! ?& j& |( v5 F8 G
+ }$ Q& ~9 a5 o+ Z分成selectI/O和differentialI/O
3 ^# X' P0 z% A/ k7 V0 m
6 F4 h7 }3 s  G5 `  [6 `! C! i是說~
, V3 V3 j$ ?) t/ ~  h
8 d; j: f. V1 w5 i9 `# l因為我現在要用FPGA外接一顆DAC作光學實驗
' _+ K- N# |" ^/ v
/ h) b- I9 N' v) L, Y1 l0 ]# F$ [, J若我選用的DAC傳送介面是LVDS或是RSDS這類~& i; n6 C- n/ L$ [" @/ d4 ~
" ^1 P$ ~9 _* p9 b0 H; P- Y
那fpga它速度上就要看differential i/o這一項嗎??
7 q& B% g+ y! O+ l% o
1 F! g1 Z; g. \+ f- P: y; J因為高速的DAC介面大多是LVDS% g" B, o3 |; B5 R# h+ ?
9 i7 }3 r! R0 `# Z+ T
==============================================8 T/ r5 G1 c/ o9 w9 r

7 v% o$ E# m) K7 U6 j0 x) b像這一顆(AD9734)
* d, e. }; O) S0 G# C! C# Hhttp://www.analog.com/en/prod/0,,AD9734,00.html6 R: S* C6 U% a- {5 M
" X; n! B9 q( G5 ?2 u8 Q5 L
他介面寫說用LVDS
4 G0 f. u9 R6 V7 u
6 o; R) G$ s" o. r/ m. W7 l0 h但又寫著
/ Z* \! E7 s5 n1 V) a/ uDouble data rate (DDR) LVDS data receivers support
1 b/ R( T1 `" i- x) Wthemaximum conversion rate of 1200 MSPS.8 m4 M/ T7 r7 p1 z& f
) g+ u7 F/ M* a+ E; t
我搞不太清楚  = =?
1 h6 T/ C2 {" B, Y- P4 E
& _) W/ ^& m* S: A% P# Z& x==============================================
5#
發表於 2008-3-30 17:13:49 | 只看該作者
簡單的說...
8 {, m. D4 D& E+ }1 @! {
4 f; j: [1 r2 g, c, y0 z你需要Virtext-5的FPGA (可以傳1.2G LVDS)去配合AD9734
4 S8 O, g/ w1 T6 v  U9 ~" z  h5 o  N: l: C8 O4 U0 W, E3 k$ u
好巧...二顆我們公司都有賣
6#
發表於 2008-11-24 15:37:47 | 只看該作者
I had trouble to control AD9734  from FPGA. Do you have some examples ?2 u0 U2 t6 Q2 v3 A" W8 C; Q% C, W

- ~4 o, ]7 ^3 PThanks
7#
發表於 2008-12-15 16:32:12 | 只看該作者
有電路圖嗎?
# t. T; f  H) x: ~3 |7 b至少先看過FPGA跟AD9734的電路才好討論
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