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[問題求助] 用verilog撰寫取對數log電路

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1#
發表於 2010-12-15 23:48:26 | 顯示全部樓層
先回覆,改天在來看code  E% h2 J7 N1 n9 \

0 E1 ], B: t( G: q9 |: W2 l& Y  _我也有在做對數轉換器
) P6 K. v+ b" f; |4 Z% m我是將數字表示成 N = 2^k(1+x)! r; D. w; U; e) J
以Mitchell的方法為基礎進行改良
$ H( h# @4 E' z* ]: p
1 g3 ]$ G8 c% B5 ]) [% k! X) i, t3 k好久沒上來了XD
& e0 J5 z/ F# U: c' Q上一次來是在問FPGA方面的東西; w4 W" L( W& J5 K# g
因為要在上面實做對數轉換器
/ P! H* j4 M* S) Q9 T" Z不過那時沒得到協助) x. i: B& O  @4 |- _& T  Q) u
幸好最後有成功做出來
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