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[問題求助] 請教VHDL

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1#
發表於 2008-2-1 06:51:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
當我宣告如下:
& q. c' `. F$ CA : in :std_logic_vector( 7 downto 0);
% E, p" m5 h- F$ k/ G請問為何只有需要一隻腳就可以代表8 bits,可是我們實際用的IC都是8條資料線,我有點混淆,能否請教大家,指點一下,感激!
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2#
發表於 2008-2-1 08:59:17 | 只看該作者
這應該最基本的訊號宣告格式, 其實它宣告出來是個array,   }: a9 s# g% y: h# r5 u9 ~
( 7 downto 0); 共 8 個 bits
3#
發表於 2008-2-4 08:56:08 | 只看該作者

那是8條線,

那是8條線的 bus. 只是用了一個名字.
4#
發表於 2008-2-4 09:39:19 | 只看該作者

回復 1# 的帖子

那是Array或Vector的宣告方式吧/ b: f1 w3 Q' @) X: Y* f+ w6 C
像Verilog 你也可以寫成) g' p* M8 C6 c! j
Input   [0:7]  In;
) _0 V! t: B, Z的道理是一樣的
5#
 樓主| 發表於 2008-2-5 16:13:57 | 只看該作者

請教VHDL

原來如此,感謝各方的意見與指教,另外小弟再請教個問題$ c9 D3 n$ ^# e6 L/ n

/ z8 K" Z( v& v' f5 i# C" Khttp://www.xilinx.com/products/boards/s3_sk_promo.htm
7 v" h* N6 @$ N% P1 P% m% E4 |+ u
: J6 @8 Z5 I8 F, t7 T' [! d這個網頁上的tool kit哪種比較適合買來自己用?
% I. y4 z0 b, ?5 Z/ B8 o: k* V' T1 k7 u0 a4 U) |' E7 g! }
Sparten 3 跟 Sparten 3E的差異有哪位知道的呢?
: S+ o+ b5 ^2 _$ |* J/ S8 ]5 _
! Z, N/ B- f6 n! w我想買一個適合自己練功且又便宜的ASIC tool kit,希望日後也可以支援個人所設計的DSP處理器的燒錄
9 c/ z6 f* a9 w
2 C" Q7 J' a# Q1 n懇請大家給我點意見,xilinx的產品線好多,讓我實在是有點眼花撩亂呀...
6#
發表於 2008-10-24 09:36:40 | 只看該作者
"A" is the name of bus, it is not line
7#
發表於 2009-6-8 17:30:47 | 只看該作者
其實我認為用哪一種工具都差不多
  s6 m' I; D# n7 N$ p+ q最重要的是看你的需求
1 m5 n7 m4 F& S( A& `5 e若你的需求是純練功
2 F6 w( O+ u. `( ?) D個人認為用到xilinx太高檔的....' {$ t4 `2 T' m
你可以考慮用altera的會比較便宜
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