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[問題求助] MoM電容在LVS的錯誤

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發表於 2022-7-20 11:16:55 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 wuhy 於 2022-7-20 11:18 AM 編輯
; v1 Y" N" t, L# W& _0 E
. i- l9 m: W$ h4 Y; G各位好,小第剛進入Layout工作不久,最近在繪製M1~M4的MoM遇到LVS和schematic對不上的問題7 H9 g6 h) R$ M8 `
使用的製程是SMIC013,使用工具爲Laker/Calibre
5 l# E  m7 I# @& KLVS錯誤如圖:h ttps://imgur.com/vnbjH5V5 N( d7 F4 c3 O% X

" Y% h/ Y8 _/ ^" v, bnetlist如圖:h ttps://imgur.com/IF8qvhC
. Q; n$ f# u3 H2 V' m1 E+ Z. T; V% N
7 e/ X1 z1 q& j7 B7 ~layout如圖:ht tps://imgur.com/amp5eSM
5 C, C4 d2 R/ j( T# [
6 u' S* A" w+ z8 R3 @5 B/ I
9 J" W1 S7 P0 [我確定我有加上MoM的layer讓LVS去認
' f$ d/ K) c* T8 q從LVS可以看到他有抓到MoM,且生成了mom14_ckt的子電路
( ?, i3 d1 S) I: D+ K( Z但問題是LVS生成的layout spice內mom14_ckt是空的(我猜是based on名為empty_subckt.sp的檔案生成layout spice)
- @7 V3 B: p& g; @3 _) f+ Q, x所以LVS才會報錯" d" E: o" C0 R3 e$ B/ c
- V  W( P; G' B- I& F
我有看到有人在Calibre->Setup->Netlist Export Setup的Include File填入empty_subckt.sp的路徑(h ttps://zhuanlan.zhihu.com/p/87398682)
( n$ _& ^: q+ a9 \7 C, R& ^$ r, j  p; l2 ~2 N* Z

3 e$ b( ]) V, X2 L但我使用的laker找不到能設定netlist export的地方
# q: {6 @, z* V: F$ k* `/ \ht tps://imgur.com/jzWvgoV# z9 f- O+ h, X2 P: W8 T- C

! J3 r' ?. H) d8 @請問各位先進我該如何處理這個問題?: T1 y6 e) f) z  ?, b/ `
1 c& {+ ~. [6 u4 N' Q8 w

: P6 {% t& C# R; }
. g" x" M5 h* I# O
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