CIC類比IC競賽決賽-電路除錯求救

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今年參加CIC競賽決賽遇到一些問題，想請教專家意見。
4 F' i) K9 r( v4 S7 |1 ^% Q            
這是今年決賽的電路圖，為6bit log DAC，使用0.35um製成，工作電壓3.3v。
/ v0 m# I$ i# {4 C' J2 T# S/ Q初始時會對63C充電至2v，再利用C減少63C儲存的電荷，最後用Buffer輸出。

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這是時序圖，CLKb為CLK的反相訊號。
$ O/ _* |  j! }: G& h& K! O0 f: p參數規格要求DNL<0.5 LSB，在比賽時確認有達到標準，但成績公布時DNL參數卻大於0.5 LSB。
以下是成績複查的結果
         
在63個DNL數值中，前62個都正常，但為什麼在最後一點突然超標，
實在想不出哪裡出錯，拜託各位專家高手替我找出問題。


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fordayever

如果確認63C及C charge sharing的結果都符合預期
可以看看Output buffer的input range足夠嗎?

YMCK

想請問樓主是比full custom的嗎