Cortex-M0/M3/M4 Source Codes

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Cortex-M0/M3/M4 Source Codes
) ]9 O: v2 ?5 q( {* o& m
iconstart@gmail.com
! K6 G0 P: [( a/ R* W2 A' M# k
├─AT420-DA-03001-r2p0-00rel0
' J& b' d- a( N! X6 O' R│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
* N+ b$ |" E3 p2 N│         
├─AT420-DC-02008-r2p0-00rel0
: T! s% @, N# e│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
├─AT420-DC-13001-r2p0-00rel0
' V- ]& k1 R& B* z* K; t% T1 i5 w  Q│  └─docs
3 r/ Z. r0 G1 S6 b- I, K
│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
  s) j0 M$ e  P. B9 o│  │  │          CM3ROMTable.v
* T: {0 P8 y* U; x/ A$ S( a" k6 \: i$ x│  │  │          CortexM3Integration.v
; W' V3 V1 H. x  v│  │  │         
│  │  ├─dapswjdp
1 ~1 |$ Z+ [  z, n# ?& o  U│  │  │  │  README_DAPSWJDP
│  │  │  │  
: Z$ ^" `! T; z- d! D; g9 t│  │  │  └─verilog
( E* _" g0 \& F! Q│  │  │          DAPDpApbDefs.v
( O' n4 R" U1 U│  │  │          DAPDpApbIfClamp.v
- m; W+ P& b* ?- t0 v+ M│  │  │          DAPDpApbSync.v
6 |3 V8 W2 A+ K0 _; x4 K" e! C│  │  │          DAPDpClamp0.v
6 U5 _; R# c6 q! L│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
: @, b$ R" J& u: }; J│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
2 Y$ v1 h5 N# l" A│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
% J. O0 B: I- u: i│  │  │          DAPSWJDP.v
( K4 Z7 l  D7 ^1 j4 h2 r│  │  │          DAPSwjDpDefs.v
5 Q) _/ G* M0 g+ O2 J( k3 [7 V2 n│  │  │          DAPSwjWatcher.v
" c' t  c9 P( `│  │  │         
" q6 u; A7 ^" A; G│  │  ├─models
, R, M+ E  m2 t9 O│  │  │  └─cells
& J' {4 b! e/ {- u9 }* z│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
3 S0 d. y+ R( ~/ a! D+ c│  │  │          CM3Sync.v
. `3 B* A  D& T/ \" M- a│  │  │         
│  │  └─tbench
9 X" Q7 r5 m* W' M. v9 m/ J9 r│  │      └─verilog
( e3 v) k4 w0 Y5 p, P& U( l! ~- X│  │              AhbToApb.v
6 b, K( I8 [% c. _│  │              AtbLogger.v
) {* a1 x% A$ w0 [( V│  │              BusMatrix.v
│  │              ClkReset.v
" j( I8 f) A; f- K+ l2 @* u│  │              CM3BusComparator.v

/ O  u: Z% O/ O5 A+ N) W
│      │  │  exclude_list.sc_waitstate

& w8 s  ]3 z" ?& {# Q$ P             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
& I  U; Q& i* `8 y  g: h7 l) i             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
; @1 S( B, a- G# i             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
# g1 H+ i+ l6 q, o- c4 ]2 d             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
+ V/ ~: R' J" i3 h5 \             │              cells_1.geo
             │              cells_1.pwr
; X8 l4 I7 _7 G8 Y% b             │              index.cli
             │              README.TXT
- o" Y6 G+ h9 J$ l4 M4 A. W             │              rulesets
; z  j4 R( J8 T3 c6 v. X8 c             │              VERSION.TXT
             │              vias_1.geo
             │              
. P+ z# G" T* j) f) ^! n             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
6 l5 k' Q1 G/ b. {                             corner.defs

├─integration_kit
│  ├─logical
, }5 @% c' B' r5 O$ a+ D│  │  ├─cm0ikmcu
" F5 g: Z% b. S& [4 l% n, \+ d4 L│  │  │  └─verilog
│  │  └─tbench
: u8 V* W* ?& t│  │      └─verilog
4 a0 W+ q  c. {! y" c+ Y│  └─validation
  I9 C; f, l  u' ]6 K4 G│      ├─glogs
│      ├─logs
  q, O" m# c9 K' d( [│      ├─mdk
│      ├─srpg
+ ~5 y3 e4 f- A$ H  h8 s│      ├─tests
│      │  └─CMSIS
. [3 k7 C2 ^. \2 j6 r│      │      └─Core
( ?5 p  d3 E- s/ m│      │          ├─CM0
│      │          └─Documentation
│      └─vectors
6 A5 E; a) w( w2 ?/ L├─ipxact
│  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
5 y' b5 |: s" V' n│  │  └─arm.com
│  │      ├─CoreSight
│  │      ├─Cortex-M0
│  │      └─CortexMCores
, V+ a5 f" `: O* w0 u2 O/ C│  ├─channels
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