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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › pulse synchronize issue
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[問題求助] pulse synchronize issue

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jyunwei
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1#
發表於 2014-3-6 12:45:40 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
如果有一個PULSE訊號，PULSE和PULSE間相隔很短
" m5 K. R2 H4 i那要如何做SYNC到另一個CLOCK DOMAIN呢?
. j1 ~& d% c+ a( q& w從快的CLOCK到慢的CLOCK
. |. P& u8 l" B4 ?. {. u/ r( P; y  u/ g
請大大指點一下，感恩萬分
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