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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 用Verilog撰寫(浮點運算)開根號的電路
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[問題求助] 用Verilog撰寫(浮點運算)開根號的電路

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1#
發表於 2012-12-12 21:23:35 | 顯示全部樓層 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 key456456 於 2012-12-12 09:31 PM 編輯
3 H# y: D9 s  H9 _" w  |3 r6 O. |7 n. e
請問大大們有沒有sqrt的code
  W: l" z& j* w4 }- s
- q# u, p/ b  \: f- L/ C想看看研究一下; \5 P: B: x2 z: f  m' B3 J

# \. q: m+ h" W8 b/ S, Q自己實力不夠寫不出來
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