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商周出版一本書: π型人:職場必勝成功術,,
* ~6 w! m; j# i7 o1 k4 \- N# c裡面提到「「π型人」的方法,讓你在最短時間內,選擇適合自己的第二專長,並與第一專長融合,發揮一加一大於二的威力,帶你安然度過景氣寒冬,成功迎接春天的到來。」
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在IC Layout世界裡, 小弟的解釋為:
4 I4 H' ]2 I. P2 c/ p- j4 J8 SIC Layout工程師,除了提升本身IC LAYOUT的技能外,(平常多閱讀國外期刊,美國佈局專利或進修等..)) e" n5 z x2 E( `0 A
另外再學習和本身工作的前、後,也就是上下游相關的知識.
) M4 c% X" |& i* D( H例如:IC設計和 晶圓製程或 CP測試3 R' e0 \; ^3 ~& o
% J. P" G! G2 F: m* I( |* P( z. z3 z; }(??? 有人一定會問我,IC LAYOUT 學IC設計和測試做啥?) % K/ g, [' } K, t* ]
隨著製程演進, IC Layout在舊製程不存在的問題, 在前瞻製程未必不會碰到,
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學習IC設計並不是要超越IC Designer,而是為了能更清楚的溝通電路設計理念,7 `$ V& R5 n2 }3 Y$ F/ l
學習晶圓製程或CP(Wafer sort)也不是要成為製程或測試工程師,," v7 f7 l9 a" }- }+ [6 G
而是要了解自己的佈局在台積電裡面會怎麼跑, I/O PAD的擺放對CP(Wafer Sort)測試結果有沒有影響,或是可以最佳化
! {$ |* W8 ~- }6 k當然公司或Fab一定會有舊的Rule可以依循, 但是Rule為什麼要這麼定通常了解不深(因為太忙了..沒空想那個)6 i9 W8 K+ G9 G+ D1 ^. S! w2 E, n- v: p
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所以試著了解上下游合作的工程師在做什麼,, 辛苦一陣子,,
- ?2 z4 y3 O+ X4 N& d必然可以脫離 「像是在 做工ㄉ感覺得,, 」
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共勉之~ |
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