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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:
9 T. N: W' b: c" a7 W/ y: [- b; Y$ E9 b( }
想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程
4 M) \$ Z7 F+ w: |+ }# n- P& NSYSTEMC擅長前段
4 F) ^$ t+ ?0 `7 |; u: |6 ]StstemVerilog則後段功力相當了得
( T# T: b& \. p7 ~1 X0 U$ d4 ^' x可惜這兩種標準還無法做有效率的整合
" d7 b$ _" \; k3 ^/ U學界已經有很好的整合經驗
9 _: a2 h) X+ N4 |但是業界中小型還在探索階段或根本沒有7 B" h% f3 G% p
大型的Design House & Design service company有專門的部門在研究 / n; O) c; l& b4 S9 w
但只是部分導入在複雜的SOC上# k1 W1 O1 w, F* {6 i9 G
總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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