關於verilog的除頻器無法使用modelsim模擬

leon1235 · 發表於 2010-9-17 23:33:25

下面分別是我寫的除頻器及它的激勵源
但我使用modelsim時卻無法正確的讓它產生振盪
該波形完全處於0狀態
但實際用fpga燒入以視波器測卻可測得其波形
不知道是modelsim本身看不懂我寫的
還是我根本就寫錯了
又或者是testbench沒寫好？
煩請各位大老多多賜教！！

module F40M20M20k50(F40M, Rst, F20k);
input  F40M;
input  Rst;
output F20k;


   reg F20k;
   reg [10:0]B2000;
reg Count;

always@(posedge F40M)
begin
if (Rst)
begin
   B2000 = 0;
   Count = 1;
end

else
   begin
      if (B2000 == 2000)
      begin
      F20k = ~F20k;
      B2000 = 0;
      end
      else
      begin
      B2000 = B2000 + 1;
      end
   end

  end

endmodule

---------------------------------------------------------------------------
`timescale 1ns/1ns

module testbench;

reg F40M;
reg Rst;
wire F20k;

F40M20M20k50 ReiRong (.F40M(F40M), .Rst(Rst), .F20k(F20k) );

initial $monitor($time, "F40M = %b, Rst = %b", F40M, Rst );

initial begin

F40M = 0;
Rst = 1;

end

always #25 F40M = ~F40M;
initial
   begin
#100
      Rst  = 0;
end

endmodule

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