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樓主: kyokanasaki
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[市場探討] 眾人都會IC設計

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21#
發表於 2010-10-10 15:12:07 | 只看該作者
even 是digital IC* ]. f+ I& h4 ?, C% K; _# q2 X
說難不難,說容易也不容易,
" H6 g8 p0 T8 }& Z4 M- A4 J會做的還是缺創意
22#
發表於 2010-10-25 08:10:05 | 只看該作者
編輯觀點:你是否樂見下一代也投身工程師職業?
! y1 C1 }/ Z0 n: _6 @4 i電子工程專輯 - ‎2010年10月21日‎
7 J# x* m* p* }& E3 Z; \% d) e
我們常聽EETimes的電子工程師讀者聊到,他們打算阻止自己的子女未來從事相同職業,所持的理由很多種,但大多數人的結論是,在全球化的趨勢下,當工程師幾乎不可能成就一番大事業,也越來越難餬口。 這真是很悲哀…其中一個可能導致的結果,是讓大量人才轉向投入金融服務等 ...
23#
發表於 2010-11-14 12:16:57 | 只看該作者
官大學問大!& {, \8 O& H. D+ y
應該說眾老闆(含教授及主管)都會IC設計,
3 Q; U5 q+ D5 {( ]: O因為他們的知識大多來自下屬及學生的報告,$ P/ r7 I! c7 `9 T7 N
老闆每次都跟客戶吹牛他設計的電路有多難,
/ M' w* F) s) m) B/ ~實際上那電路根本都是他的工程師幫他設計的.
24#
發表於 2010-11-17 11:35:29 | 只看該作者
回復 23# liger - G( t* h/ y. x. Q/ B5 g! R' p# T9 G
, Q4 X& R+ B: p8 F. ^; N& q" M
2 V+ l0 ]/ q7 V) M+ U6 ~
也不全然是這樣, 也許您待的是大公司吧?!
4 y% X" O: t0 o* L3 a若是待start-up, 主管沒一定本事可是沒人會去挖角的....( S7 n' u3 P0 X/ F! H
IC設計的功力, 最基本的電路部份有了一定修為之後, 差別就在debug的能力了
# v5 b! }% }1 R這部份得靠經驗累積....
25#
發表於 2010-12-8 17:02:12 | 只看該作者
感謝24#前輩的回復,的確我的講法有點一概而論,- Y8 `7 S; {5 [8 i' q. ^) L5 E
不過通常會出來開design house大多是數位領域出身的老前輩,
4 s' s9 o6 m" ]& U; n# s/ B所以是否為類比人才他跟本沒有能力去判斷,5 ]' d5 i' X" m7 u
且自己很愛面子,以吐嘈別人來裝懂,甚至還會說數位比類比難,  `$ {  N( T0 v0 `" t9 F& ~
下屬還要裝作很受教的樣子.
+ E( t( X0 Q  y' ?+ u+ @9 M累.....(沒辦法花錢是大爺嘛)
26#
發表於 2010-12-30 08:51:58 | 只看該作者
主要看自己是否喜欢,有多大的把握可以做好!
27#
發表於 2010-12-31 08:57:14 | 只看該作者
非常贊同15樓的說法,不見得是資工的,即便是EE科班的也有很多會一些logic就以為自己多強,
$ b  H3 O2 \$ v只是一些騙女生的把戲而已,說實在的真的要訓練一個數位工程師只要三個月的時間.
28#
發表於 2011-1-14 00:04:18 | 只看該作者
微电子设计需要研究所的水平吧 在下严重感觉这样
29#
發表於 2011-1-22 04:30:34 | 只看該作者
说IC设计简单 如果是资深前辈 当然有不同的见地; 如果想做科技攻关, 有能力的话就不会在这里侃侃而谈了吧.
30#
發表於 2011-3-12 09:03:32 | 只看該作者
我適感覺順其自然~$ N- L0 K$ u1 Q3 ?- K+ O( Z
當你能力夠 又強
! ~6 w; }; Z; y4 J: ]& w; \老闆當然會讓你起來
31#
發表於 2011-4-6 18:18:12 | 只看該作者
我是數學系畢業的, 於民國90年轉入IC設計,& }* b+ v7 `$ h3 ?! y2 b9 p0 h* G
撰寫Verilog確實不難, 大約半年就可出師了,
# T, M$ H  N) ^又加上有FPGA可以驗證, 所以出錯的機率著實不高,1 G" ^) D* T; h# a, w7 J- e) Q. W' u
但那只能說function work, 要達到量產, 還有一段距離,; ]/ }! Q: ], w
以下是我經驗:
. h& q0 ?: C# |  D5 Q1. 現在的IC不可能是純數位, 所以會有analog circuit在IC中,
9 ]+ c  s2 g+ ?  M- {    最難的就是analog與digital interface,
6 g# P6 y; r+ C  l/ ^% j    常常就是analog simulation ok, digital用FPGA verification也ok,/ m! w3 s# ~% N0 @+ @3 g0 [/ \
    但實際開出IC卻有問題, 而且弄不清楚是analog還是digital.
4 P2 m6 ~( P! p& e) r1 q: M2. 現在IC cost-down很嚴重, 所以Verilog大家都會寫,' c9 d. w' G% @
    但要怎麼把die size縮小, 那就是一門學問了.% _2 a8 ^8 ]  Y! l
3. 測試又是另一個問題, 雖然有tool可以產生test-pattern,4 I; C9 a4 W$ J, ]" [! ]
    但要怎麼把測試的覆蓋率提高, 又是個挑戰.
; b% x) Y. T6 K2 G4. 另外, 還有一個重要的課題...EMC,
- N+ Z/ P6 k$ N5 c: S! H# v) `    這個就要有很多的經驗值了, 因為都是要IC出來後才知好壞.5 b3 l- m, h: Q1 B
5. 最後, 雖然有tool能修改code降低power consumption,9 E) e/ D! }7 h3 S8 t8 w9 [' ^
    但不注意對正常function有時會影響到, 所以需要一些經驗值.) e+ L, ^& z( Y8 r
以上就是我的看法, 給大家參考.
32#
發表於 2012-4-17 17:43:51 | 只看該作者
回復 10# jasonlhb
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